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文檔簡介
1、ESD(靜電釋放)保護電路是芯片中不可缺少的部分，近年來，隨著半導(dǎo)體技術(shù)的進步和電路復(fù)雜程度的增加，要保證全芯片的電路免受ESD電流的損壞，必須結(jié)合具體的版圖來設(shè)計整個芯片的ESD保護網(wǎng)絡(luò)。芯片的ESD保護網(wǎng)絡(luò)設(shè)計得是否合理，直接決定了芯片的整體抗ESD能力。
論文首先介紹了當(dāng)前芯片中使用的多種ESD保護電路的結(jié)構(gòu)和工作原理，在這些保護電路都符合各自的ESD保護要求的情況下，再利用這些保護電路來設(shè)計全芯片的ESD保護網(wǎng)絡(luò)。
2、論文著重研究了全芯片ESD保護網(wǎng)絡(luò)的設(shè)計方法，在全芯片ESD保護網(wǎng)絡(luò)的設(shè)計過程中，論文先從計算導(dǎo)線的延時入手，通過一些簡化、近似，將復(fù)雜的導(dǎo)線延時情況轉(zhuǎn)換成只與導(dǎo)線的寬度和長度有關(guān)的量；然后結(jié)合設(shè)計中所使用的箝位電路以及導(dǎo)線的延時情況，研究各種ESD模式下的電路模型；最后利用這些電路模型來研究ESD保護網(wǎng)絡(luò)的設(shè)計方法。通過該模型和方法來設(shè)計ESD保護網(wǎng)絡(luò)，設(shè)計過程被大大簡化。
利用本論文所研究的設(shè)計方法設(shè)計出的256路輸出
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