2023年全國碩士研究生考試考研英語一試題真題(含答案詳解+作文范文)_第1頁
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1、近年來等離子顯示器(PDP)己成為高清晰度電視(HDTV)及壁掛式彩電的主流產(chǎn)品之一。然而過高的成本成為PDP普及的主要障礙,其中昂貴的驅(qū)動(dòng)芯片是PDP高成本的一個(gè)重要方面,因此,迫切需要研制出具有自主知識(shí)產(chǎn)權(quán)的低成本的PDP驅(qū)動(dòng)芯片。本課題任務(wù)就是針對(duì)基丁體硅工藝的PDP高壓驅(qū)動(dòng)芯片的開發(fā),研制山高性能的高低壓轉(zhuǎn)換電路,以滿足低成本PDP驅(qū)動(dòng)芯片的市場(chǎng)需求。 本論文綜述了PDP的特點(diǎn)、應(yīng)用以及國內(nèi)外PDP行列高壓驅(qū)動(dòng)芯片的研究

2、和發(fā)展現(xiàn)狀。對(duì)PDP驅(qū)動(dòng)芯片中高低壓轉(zhuǎn)換電路的研究和發(fā)展現(xiàn)狀做了簡(jiǎn)略的介紹,分析了這類電路的特點(diǎn)和改進(jìn)方向。以此為基礎(chǔ)提出了一系列用于指導(dǎo)該類電路開發(fā)的設(shè)計(jì)原則和一套科學(xué)可行的設(shè)計(jì)方案。隨后在這些原則的指導(dǎo)下,應(yīng)用該方案基于無錫上華1.5μm標(biāo)準(zhǔn)CMOS工藝線設(shè)計(jì)了PDP數(shù)據(jù)選址芯片SED9006S7中的高低壓轉(zhuǎn)換電路。該設(shè)計(jì)方案分低壓延時(shí)驅(qū)動(dòng)電路設(shè)計(jì)和信號(hào)電平提升電路設(shè)計(jì)兩部分,低壓延時(shí)驅(qū)動(dòng)部分又分為延時(shí)級(jí)電路設(shè)計(jì)和驅(qū)動(dòng)級(jí)電路設(shè)計(jì)。在

3、研究了多種延時(shí)級(jí)電路的基礎(chǔ)上提出了一種易于調(diào)整延遲時(shí)間的新結(jié)構(gòu)的延時(shí)級(jí)電路。在信號(hào)電平提升電路的設(shè)計(jì)優(yōu)化方案中。針對(duì)最常用的CMOS六管結(jié)構(gòu)的高壓電路通過Hspice軟件仿真確定了各設(shè)計(jì)參數(shù)對(duì)最終設(shè)計(jì)目標(biāo)的影響。該設(shè)計(jì)方案分為三個(gè)步驟,逐步縮小了優(yōu)化范圍,最終通過高低壓電路的整體聯(lián)調(diào)確定了應(yīng)用在PDP的數(shù)據(jù)選址芯片SED9006S7中的高低壓轉(zhuǎn)換電路的各器件尺寸參數(shù)。在對(duì)版圖進(jìn)行了工藝兼容性設(shè)計(jì)和工藝可靠性設(shè)計(jì)之后在無錫上華流片。對(duì)流片

4、后的測(cè)試結(jié)果進(jìn)行了分析和比較,驗(yàn)證了該設(shè)計(jì)的正確性和可行性。在論文最斤的展望中提出了該課題的后續(xù)研究方向。 SED9006S7芯片的實(shí)測(cè)結(jié)果顯示該芯片的電壓、電流、功耗和頻率等技術(shù)指標(biāo)均符合實(shí)用要求,且優(yōu)于國外同類芯片,而加工成本也大大低于國外同類產(chǎn)品。該設(shè)計(jì)方案的提出,向研制具有自主知識(shí)產(chǎn)權(quán)的低成本的PDP驅(qū)動(dòng)芯片的目標(biāo)又邁出了堅(jiān)實(shí)的一步。 本論文在低壓電路結(jié)構(gòu)上有所創(chuàng)新,提出了一種易于調(diào)節(jié)低壓驅(qū)動(dòng)信號(hào)延時(shí)大小的低壓延

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