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文檔簡介
1、本文在分析現有動態(tài)可重構處理器設計的優(yōu)點和不足的基礎上,提出了一種改進的陣列型動態(tài)可重構協(xié)處理器設計—IRAC(Improved Reconfigurable Array Coprocessor)。相比于其他同類型設計,本方案在可重構處理器的配置靈活性,系統(tǒng)的數據傳輸效率和蝶形算法執(zhí)行效率上均進行了改進。仿真結果顯示,對于2D-DCT,FFT等典型的數字信號處理應用,IRAC具有比大多數同類設計更優(yōu)的性能。本文在以下幾個方面為可重構系統(tǒng)
2、提供了新的思路和觀點IRAC與其它同類型可重構處理器的顯著不同就是將系統(tǒng)中可重構區(qū)域合理的劃分為若干個子區(qū)域,每個子區(qū)域擁有單獨的配置字存儲器,在運算時可以根據需要采用不同的配置,提高了配置的靈活性和算法映射的效率。設計中采用雙通道DMA控制器,可以同時對配置字和數據進行傳輸,有效的提高了可重構系統(tǒng)的數據傳輸能力。針對常用蝶形算法(如2D-DCT、FFT),對陣列中的可重構運算單元以及運算單元間的互聯結構進行了改進和優(yōu)化,提高了系統(tǒng)進行
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