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文檔簡介
1、本文設(shè)計并FPGA硬件實現(xiàn)了一種分組密碼協(xié)處理器，主要的目標是設(shè)計能在多種總線環(huán)境下可重用的協(xié)處理器，并且要求能靈活更換協(xié)處理器內(nèi)部的分組密碼算法模塊。為了實現(xiàn)設(shè)計目標，協(xié)處理器采用了分層的控制結(jié)構(gòu)、Start-Done控制協(xié)議以及類似RAM的外部接口信號定義。實驗證明，只需進行較小的修改，就能將協(xié)處理器的3DES算法模塊更換為AES-128算法模塊或者將AES-128算法模塊更換為3DES算法模塊。 分組密碼協(xié)處理器現(xiàn)已成功的
2、應用到了廣州大學信息安全技術(shù)實驗室研制的PCI-FPGA密碼卡中。本文介紹了協(xié)處理器在密碼卡的PCI9054局部端總線環(huán)境中的應用，并且介紹了協(xié)處理器在Windows2000/XP操作系統(tǒng)下與主處理器(IntelPentium4)協(xié)同工作對文件數(shù)據(jù)進行加/解密所需的軟硬件協(xié)同設(shè)計方法。此外，協(xié)處理器也已經(jīng)在LEON2片上系統(tǒng)中進行了初步的應用。利用協(xié)處理器外部接口信號的特性，可以以一種快捷的方式將協(xié)處理器應用到LEON2的AHB片上總線
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