集成電路中的芯片數量按照摩爾定律預測的速度飛速發(fā)展在集成電路的設計中需要尋求新的互連技術三維集成電路TSV硅通孔技術引起了廣泛關注。三維集成電路提出了一種全新的提高IC集成度的方法而TSV硅通孔技術作為一種全新的互連技術在三維集成電路中有著非常重要的作用...
下載價格：5 賞幣 / 發(fā)布人： 回首 / 發(fā)布時間：2024-03-09 / 4人氣
隨著集成電路工藝進入納米尺寸，芯片功耗成為一個越來越重要的設計因素。根據最新的研究1表明，相對專用集成電路APPLICATIONSPECIFICINTEGRATEDCIRCUIT，ASIC，現(xiàn)場可編程門陣列器件FIELDPROGRAMMABLEGATEARRAY，F(xiàn)PGA實現(xiàn)相同功能電路的動態(tài)功耗是其7～14倍，靜態(tài)功...
下載價格：5 賞幣 / 發(fā)布人： 抱緊你的呵護 / 發(fā)布時間：2024-03-09 / 3人氣
隨著制造工藝的發(fā)展，功耗成為集成電路設計中的一個十分關鍵的問題，傳統(tǒng)的低功耗設計主要圍繞動態(tài)功耗的估計和優(yōu)化展開。進入深亞微米工藝后，出現(xiàn)了很多新的功耗問題，例如漏電流的迅猛增長引起了一系列新問題的產生。本文主要研究漏電流的估計和優(yōu)化以及與之相關...
下載價格：5 賞幣 / 發(fā)布人： 束縛 / 發(fā)布時間：2024-03-09 / 10人氣
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下載價格：5 賞幣 / 發(fā)布人： 歲月那么長 / 發(fā)布時間：2024-03-10 / 5人氣
低功耗設計方法,,內容,CMOS電路的功耗來源影響功耗的因素低功耗設計方法工藝級的優(yōu)化技術版圖和晶體管級的優(yōu)化技術RTL級和邏輯級的優(yōu)化技術系統(tǒng)級的優(yōu)化技術采用HDL的低功耗設計流程,CMOS電路的功耗來源,在數字CMOS電路中，功耗是由三部分構成的PTOTALPDYNAMICPSHORT...
下載價格：4 賞幣 / 發(fā)布人： 畢業(yè)設計 / 發(fā)布時間：2024-01-06 / 5人氣
西安電子科技大學碩士學位論文TSV功耗建模與3DNOC功耗分析作者江鵬導N蔡覺平教授學科微電子學與固體電子學中國西安2012年1月TSVPOWERMODELAND3DNOCPOWERCONSUMPTIONANALYSISL●，ADISSERTATIONSUBMITTEDTOXIDIANUNIVERSITYINCANDIDACYFORTHEDEGREEOFMASTERINMICROELE...
下載價格：5 賞幣 / 發(fā)布人： 如同昨日 / 發(fā)布時間：2024-03-10 / 9人氣
近年來，處理器的性能依然遵循摩爾定律不斷提高，功耗也隨之增加。各類便攜智能終端和移動通訊設備迅速普及，人們對移動計算的要求越來越高。這些移動計算設備通常采用電池作為重要的電力來源，而電池技術近年來沒有重大突破。如何降低功耗，以便在有限的體積、重量...
下載價格：5 賞幣 / 發(fā)布人： 停杯 / 發(fā)布時間：2024-03-10 / 11人氣
近40年來，集成電路工業(yè)一直依循莫爾定律而發(fā)展，即集成電路的規(guī)模每三年翻兩番。作為集成電路最新技術的代表，SOCSYSTEMONCHIP，片上系統(tǒng)已經成為集成電路設計領域的研究熱點并得到越來越廣泛的應用。深亞微米工藝SOC芯片設計除了要考慮傳統(tǒng)的性能和成本的要求并得...
下載價格：5 賞幣 / 發(fā)布人： 披血男巫 / 發(fā)布時間：2024-03-10 / 4人氣
復旦大學碩士學位論文低功耗物理設計姓名郭小川申請學位級別碩士專業(yè)電子與通信工程指導教師曾曉洋20070526摘要在20世紀，IC設計者主要關注速度、面積、成本、可靠性，其次才是功耗。而進入21世紀，無線通訊產品和掌上電腦類便攜產品需要有限的電池容量可以支持盡可...
下載價格：5 賞幣 / 發(fā)布人： 提詞深情喂風 / 發(fā)布時間：2024-03-10 / 5人氣
該文首先從系統(tǒng)結構的角度對嵌入式系統(tǒng)的存儲層次的功耗進行研究分析研究了兩類流行的系統(tǒng)級功耗優(yōu)化方法代碼壓縮和CACHING并在此基礎上提出了改進的LOOPTABLE功耗優(yōu)化方法代碼壓縮方法通過對程序目標代碼進行重新編碼來減小程序所占用的存儲器尺寸減小訪存帶寬降低...
下載價格：5 賞幣 / 發(fā)布人： 智者 / 發(fā)布時間：2024-03-09 / 6人氣
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下載價格：5 賞幣 / 發(fā)布人： 青絲盼 / 發(fā)布時間：2024-03-10 / 6人氣
本論文研究和分析了低功耗設計技術的背景、功耗的組成和降低功耗的方法途徑。目前主要是通過降低工作電壓、降低電容和減小活動性來達到降低功耗的目的。低功耗設計大致分為系統(tǒng)結構級、寄存器傳輸級、門級、電路級四個層次，按照自頂向下的電路設計方法，在不同設計...
下載價格：5 賞幣 / 發(fā)布人： 空曠 / 發(fā)布時間：2024-03-10 / 4人氣
密碼模塊部分是信息安全系統(tǒng)的關鍵部件，其安全性的高低直接關乎整個信息系統(tǒng)的安全。21世紀以前的大部分時間，對密碼模塊的攻擊主要集中在數學分析上，主要是是以線性攻擊和差分攻擊為代表的傳統(tǒng)密碼分析方法，通過利用密碼算法的統(tǒng)計特性，通過分析所選擇的明密文...
下載價格：5 賞幣 / 發(fā)布人： 妄手摘圖星 / 發(fā)布時間：2024-03-09 / 6人氣
1/4低功耗數字壓力表數字壓力表結合了微處理技術和先進的模數轉換算法,達到高精度、低功耗的要求大屏幕液晶顯示技術，獨特的背景燈技術，使數據在夜晚也能清晰易讀。采用進口芯片，對儀表數據采集、記憶、測量保持峰值,手動回零。外殼采用不銹鋼全密封,耐腐蝕、抗震...
下載價格：3 賞幣 / 發(fā)布人： 兩難 / 發(fā)布時間：2024-05-22 / 0人氣
磁力軸承是利用磁力作用將轉子懸浮于空間，使轉子與定子之間沒有機械接觸的一種高性能軸承。已被廣泛用于機械加工、航空航天、真空技術等領域，被公認為是具有廣泛應用前景的新型軸承。磁力軸承在工作過程產生的功耗導致磁懸浮轉子溫度升高，而磁懸浮轉子的溫升問題...
下載價格：5 賞幣 / 發(fā)布人： 因果 / 發(fā)布時間：2024-03-11 / 7人氣
高速模數轉換器是一些系統(tǒng)中至為關鍵的模塊，如磁盤驅動讀寫系統(tǒng)，超寬帶UWB，ULTRAWIDEB通信系統(tǒng)和光纖通信等，在這些系統(tǒng)中需要高采樣率和中低分辨率的ADC。同時，低功耗設計也是ADC設計中一個非常重要的方面。在所有的高速ADC中，全并行FLASHADC由于其優(yōu)越的高速...
下載價格：5 賞幣 / 發(fā)布人： 你個廢物 / 發(fā)布時間：2024-03-11 / 19人氣
該文的研究背景是為面向低功耗的SOC系統(tǒng)設計中的體系結構優(yōu)化和軟件編譯器優(yōu)化提供支持從這個角度出發(fā)該文提出了一種包含指令級功耗模型和部件級功耗模型在內的兩層系統(tǒng)級功耗模型部件級功耗模型是系統(tǒng)級功耗模型的基礎它根據部件的結構信息自底向上的計算各個部件的...
下載價格：5 賞幣 / 發(fā)布人： 無力反抗 / 發(fā)布時間：2024-03-10 / 8人氣
在電子技術飛速發(fā)展的今天，VLSI系統(tǒng)規(guī)模越來越大，集成度越來越高，功耗的影響越來越被人們所重視。尤其是便攜式設備的廣泛流行，由于電池的限制，要想有較長的使用時間，就必須考慮低功耗的問題。另一方面OFDM技術在通訊領域中廣泛應用，由于它能夠非常有效的對抗...
下載價格：5 賞幣 / 發(fā)布人： 反復回蕩 / 發(fā)布時間：2024-03-12 / 11人氣
不斷縮小的工藝尺寸和超高的集成度使得集成在芯片上的晶體管數目急劇增加、功能越來越復雜給VLSI測試帶來了更加嚴峻的挑戰(zhàn)。測試數據量大和測試功耗高是VLSI測試中的兩大主要問題它們已經嚴重影響了測試成本研究高壓縮率、低測試功耗的測試方法對降低測試成本十分重...
下載價格：5 賞幣 / 發(fā)布人： 我心非石 / 發(fā)布時間：2024-03-07 / 9人氣
本文概述了研究課題的背景。介紹了低功耗技術是集成電路設計的重要研究方向之一，也是論文在研究課題選擇的重要依據。接著詳細分析CMOS功耗的來源，并得出動態(tài)功耗是主要的功耗來源。隨后深入分析了低功耗技術的現(xiàn)狀首先從原理上分析實現(xiàn)低功耗設計的理論方法，得出...
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