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1、本文對(duì)500MHz正交單芯片直接頻率合成器的設(shè)計(jì)進(jìn)行了研究。主要內(nèi)容如下： (1)4倍—20倍鎖相環(huán)參考時(shí)鐘乘法器。它采用外接低頻參考時(shí)鐘，利用內(nèi)部鎖相環(huán)路生成最高頻率可達(dá)500兆赫茲的系統(tǒng)時(shí)鐘。鎖相環(huán)路采用差分壓控振蕩器(VCO)。由于優(yōu)化了電荷泵設(shè)計(jì)，鎖相環(huán)相位噪聲更小，鎖相環(huán)頻率穩(wěn)定性更好。 (2)新穎的高速DDFS算法。采用數(shù)字方式，它實(shí)現(xiàn)了對(duì)頻率、幅度和相位的可編程調(diào)制。在500兆赫茲系統(tǒng)時(shí)鐘下，頻率調(diào)制間隔為
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