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1、分類號UDC4密級學位論文全并行Viterbi譯碼器的FPGA實現(xiàn)(題名和副題名)土壹鱉(作者姓名)指導教師姓名至整塹丞撞申請學位級別塑專業(yè)名稱墊整魚垂綾論文提交日期jQ墮6論文答辯日期學位授予單位和日期壹室堡墨盤堂答辯委員會主席評閱人2005年月日注1：注明《國際十進分類法UDC》的類號塑室堡三查蘭堡主蘭垡蘭奎全莖堡曼型堡里堡塑嬰旦壘壅塾ABSTRACTThisthesismainlyfocusesonthedesignofparal
2、lelViterbidecoderanditsFPGA—basedimplementationThedecoderisappliedtOadigitalcommunicationmodermofaprojectAtfirst，thebasicpriilcipleaboutconvolutionalcodeandViterbidecodingalgorithmareintroduced，andtheanalysisoftheerrorco
3、rrectingperformanceisgivellAfterthat，weintroducesomeclassicalgorithmsabouttherealizationofaparallelViterbidecoderForthesealgorithms’realizations，wealsodiscussaboutthehardwareoptimizationThen，atestmoduletoverifytheresilks
4、oftheQuartus’SsimulationwithMaflablanguagesisbuilthltheend，thebiterrorrate(BER)performanceoftheactualsystemislistedAccordingtotheresult，theBERperformancemeetstherequirementsoftheproject，anditalsotestifiesthevalidityofthe
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