基于FPGA的視頻處理IP核設(shè)計(jì).pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、本文介紹了基于FPGA的視頻處理IP核設(shè)計(jì)，該IP核實(shí)現(xiàn)了占用H.264編碼系統(tǒng)硬件計(jì)算時(shí)間約90﹪的核心算法模塊：運(yùn)動(dòng)估計(jì)模塊。論文首先分析了當(dāng)今流行的FPGA器件的結(jié)構(gòu)與特點(diǎn)以及IP核設(shè)計(jì)流程，然后闡述了在H.264編碼標(biāo)準(zhǔn)中基于FPGA器件核心算法模塊的具體實(shí)現(xiàn)過(guò)程，詳細(xì)分析了運(yùn)動(dòng)估計(jì)模塊的關(guān)鍵算法和基于FPGA器件運(yùn)動(dòng)估計(jì)模塊在系統(tǒng)級(jí)與邏輯級(jí)上的實(shí)現(xiàn)過(guò)程，其中在系統(tǒng)級(jí)的實(shí)現(xiàn)中給出了系統(tǒng)的模塊框圖、模塊接口圖及接口列表，說(shuō)明了接口

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