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文檔簡介
1、為了科研和教學的需要,同時為了完成上海市教委基金項目,我們自主開發(fā)了簡單實用的EDA平臺,作者完成的是VHDL語言在寄存器傳輸級的開發(fā)工具—VHDL-R語言的編譯模擬系統(tǒng).作者在設計該系統(tǒng)之前,為了深入了解VHDL語言、確立VHDL在RT級的子集(以下簡稱VHDL-R語言),對VHDL語言在RT級的應用進行了深入的研究,將VHDL語言應用在謂詞邏輯定理證明、狀態(tài)空間表示法求解過河問題、DES加密機的描述,特別是作者還參加了MCS8051
2、 IP核的研制項目.通過上述的VHDL語言應用研究,在深入了解VHDL語言和EDA工具基礎上,定義VHDL-R語言,設計與實現(xiàn)了VHDL-R語言的編譯模擬系統(tǒng),主要工作有以下幾點:1.VHDL-R語言編譯器的設計與實現(xiàn).主要工作在詞法分析、語法分析、語義分析三大塊展開,在進行語法分析時提出了一種基于遞歸算法的自頂向下語法分析方法,并在語義分析階段根據(jù)基于遞歸算法的自頂向下語法分析方法所用的規(guī)則列表提取了相應的編譯信息,生成了中間代碼,供
3、VHDL-R語言模擬器使用.同時借助對VHDL-R測試程序編譯生成的中間代碼驗證了基于遞歸算法的自頂向下語法分析方法的正確性.2.VHDL-R語言模擬器的設計與實現(xiàn).主要工作是對模擬調(diào)度算法的實現(xiàn)和算法中數(shù)據(jù)結構的改進,以及在模擬過程中對條件表達式和賦值表達式的處理.3.VHDL-R語言的編譯模擬系統(tǒng)的驗證.主要工作是將實現(xiàn)的VHDL-R語言編譯模擬系統(tǒng)應用在兩個(組合邏輯和微程序控制的)SAP-CPU上,通過實驗數(shù)據(jù)驗證了編譯模擬系統(tǒng)
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