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1、本論文的重點(diǎn)是對(duì)VHDL編譯系統(tǒng)中VHDL語(yǔ)言算法級(jí)子集抽取、詞法分析器及語(yǔ)法分析器具體編寫過程的深入研究。這幾點(diǎn)是VHDL編譯系統(tǒng)設(shè)計(jì)中最重要的幾點(diǎn)?! ”疚膶?duì)數(shù)字系統(tǒng)設(shè)計(jì)及高層次綜合做了一個(gè)整體闡述。簡(jiǎn)單介紹了編譯原理及編譯程序結(jié)構(gòu),還有VHDL語(yǔ)言歷史概述及語(yǔ)法介紹。 本文對(duì)VHDL語(yǔ)言編譯系統(tǒng)設(shè)計(jì)進(jìn)行了研究,依次介紹了VHDL編譯系統(tǒng)設(shè)計(jì)中的幾項(xiàng)關(guān)鍵技術(shù),對(duì)VHDL語(yǔ)言子集的提取和詞法分析器的設(shè)計(jì)進(jìn)行了深入的研究。并在
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