一種超低功耗、容錯(cuò)的靜態(tài)隨機(jī)存儲(chǔ)器設(shè)計(jì).pdf

1、隨著移動(dòng)通信、生物醫(yī)學(xué)和空間應(yīng)用的不斷發(fā)展，半導(dǎo)體數(shù)字系統(tǒng)呈現(xiàn)出低功耗的發(fā)展趨勢(shì)。作為數(shù)字系統(tǒng)的重要組成部分之一的存儲(chǔ)器，在低功耗方面受到了格外關(guān)注。然而，由于靜態(tài)隨機(jī)存儲(chǔ)器(SRAM)亞閾值工作時(shí)，會(huì)降低靜態(tài)噪聲容限(SNM)，這給亞閾值SRAM的設(shè)計(jì)帶來了很大難度。在亞閾值電源電壓下，傳統(tǒng)的六管SRAM存儲(chǔ)單元由于沒有足夠的噪聲容限而不能很好的工作。為了在亞閾值工作下實(shí)現(xiàn)超低功耗，有研究機(jī)構(gòu)指出通過采用讀/寫分開機(jī)制能夠有效地解決靜

2、態(tài)噪聲容限降低的問題。
　　 本文設(shè)計(jì)了一款1K×8bits的超低功耗同步時(shí)序SRAM芯片，采用基于雙互鎖存儲(chǔ)單元(DICE)結(jié)構(gòu)的SRAM存儲(chǔ)單元來消除傳統(tǒng)DICE存儲(chǔ)單元讀操作時(shí)的缺陷。利用TSMC90nm CMOS工藝對(duì)SRAM進(jìn)行了仿真。仿真結(jié)果顯示：當(dāng)電源電壓VDD為0.3V時(shí)，該SRAM工作頻率最大可達(dá)到2.7MHz。此時(shí)，功耗僅為0.35μW；而當(dāng)VDD為1V時(shí)，最大工作頻率為58.2MHz，功耗為83.22μW。