2023年全國碩士研究生考試考研英語一試題真題(含答案詳解+作文范文)_第1頁
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文檔簡介

1、高頻的頻率綜合器(Frequency Synthesizer, FS)是現(xiàn)代通信系統(tǒng)的重要部件,它的主要實現(xiàn)方式包括鎖相環(huán)(Phase-Locked Loop, PLL)和鎖頻環(huán)(Frequency-Locked Loop, FLL)。論文主要介紹了鎖相環(huán)和鎖頻環(huán)的系統(tǒng),并分析了其主要的性能和實現(xiàn)方式的差別。
  本研究設(shè)計了一款基于鎖頻環(huán)構(gòu)架的頻率綜合器,主要的模塊包括頻率電壓轉(zhuǎn)換器(Frequency-to-Voltage C

2、onverter, FVC)、運算放大器(Operational Amplifier, OPA)、壓控振蕩器(Voltage-Controlled Oscillator, VCO)和分頻器(Divider)等模塊。該電路采用GSMC130nm CMOS工藝進行了流片驗證,電路的核心面積約為470μm×350μm,后仿結(jié)果顯示該鎖頻環(huán)的鎖定時間約為1.1μs。測試結(jié)果顯示在1.2V的供電電壓下,芯片功耗為26.4mW,輸出中心頻率為651

3、MHz,相位噪聲為-124dBc/Hz@1MHz,并實現(xiàn)了頻率鎖定的功能。在本鎖相環(huán)的驗證過程中發(fā)現(xiàn)振蕩器的負載對工作頻率有較大影響。為了更簡單有效的測量振蕩器的性能參數(shù),提出了一種用于LC振蕩器特征參數(shù)的非接觸式測量方法,可以在振蕩器掉電的情況下測量振蕩器的特征參數(shù),包括諧振頻率和品質(zhì)因數(shù),并采用電子設(shè)計自動化(Electronic Design Automation, EDA)軟件仿真了該VCO的性能參數(shù),該仿真結(jié)果與理論計算值高度

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