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文檔簡(jiǎn)介
1、在上一篇博客,我介紹了并行加法。在這里,我將帶大家學(xué)習(xí)并行加一電路,并且,我們會(huì)發(fā)現(xiàn)結(jié)論相當(dāng)簡(jiǎn)單有趣。我們知道對(duì)于一位加法電路,假設(shè)AB是參與運(yùn)算的兩個(gè)位變量,C_1是進(jìn)位輸入,S是和值,C是進(jìn)位輸出,有下面的結(jié)論:S=AxBxC_1C=AB(AxB)C_1其中,第二式又可寫(xiě)成如下形式:C=GPC_1其中G=ABP=AxB我們知道對(duì)于加1電路,其中一個(gè)操作數(shù)為1,這樣我們有:S(0)=A(0)x1x0=notA(0)因?yàn)锳(0)B(0)
2、=A(0)C_1=0,于是(AxB)C_1,有C(0)=A(0)對(duì)于B(i)i=1時(shí),B(i)=0,所以,G(i)=0P(i)=A(i)。所以,C(i)=A(i)C(i1)S(i)=A(i)xC(i1),其中(i=1);所以C(0)=A(0)C_1=A(0)C(1)=A(1)C(0)=A(1)A(0)C(2)=A(2)C(1)=A(2)A(1)A(0)C(3)=A(3)C(2)=A(3)A(2)A(1)A(0)......S(0)=no
3、tA(0)S(i)=A(i)xC(i1)其中i=1。很有規(guī)律吧!求反加1描述:libraryieeeuseieee.std_logic_1164.allentityminus8ispt(A:instd_logic_vect(2downto0)B:outstd_logic_vect(2downto0))endminus8architecturebehavialofminus8issignalCT:std_logic_vect(2downt
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