基于FPGA的多處理器系統(tǒng)通訊接口設(shè)計(jì).pdf_第1頁(yè)
已閱讀1頁(yè)，還剩58頁(yè)未讀， 繼續(xù)免費(fèi)閱讀

下載本文檔

版權(quán)說(shuō)明：本文檔由用戶提供并上傳，收益歸屬內(nèi)容提供方，若內(nèi)容存在侵權(quán)，請(qǐng)進(jìn)行舉報(bào)或認(rèn)領(lǐng)

文檔簡(jiǎn)介

1、在信號(hào)處理系統(tǒng)的通信接口領(lǐng)域中，所提供的接口技術(shù)種類繁多且速度要求日益提高。由多個(gè)DSP處理器系統(tǒng)協(xié)同處理數(shù)據(jù)是很多信號(hào)處理的實(shí)現(xiàn)手段，由于DSP本身的I/O特性的限制，如果配合FPGA在邏輯方面的靈活性和多種I/O標(biāo)準(zhǔn)的兼容性，是實(shí)時(shí)信號(hào)處理通信接口的較理想的解決方案。因此，本研究立足于FPGA的設(shè)計(jì)，來(lái)解決由ADI公司DSP——TigerSHARC201組成的多處理器系統(tǒng)的高速通訊接口問(wèn)題，用FPGA實(shí)現(xiàn)TigerSHARC201鏈

溫馨提示

  • 1. 本站所有資源如無(wú)特殊說(shuō)明，都需要本地電腦安裝OFFICE2007和PDF閱讀器。圖紙軟件為CAD,CAXA,PROE,UG,SolidWorks等.壓縮文件請(qǐng)下載最新的WinRAR軟件解壓。
  • 2. 本站的文檔不包含任何第三方提供的附件圖紙等，如果需要附件，請(qǐng)聯(lián)系上傳者。文件的所有權(quán)益歸上傳用戶所有。
  • 3. 本站RAR壓縮包中若帶圖紙，網(wǎng)頁(yè)內(nèi)容里面會(huì)有圖紙預(yù)覽，若沒(méi)有圖紙預(yù)覽就沒(méi)有圖紙。
  • 4. 未經(jīng)權(quán)益所有人同意不得將文件中的內(nèi)容挪作商業(yè)或盈利用途。
  • 5. 眾賞文庫(kù)僅提供信息存儲(chǔ)空間，僅對(duì)用戶上傳內(nèi)容的表現(xiàn)方式做保護(hù)處理，對(duì)用戶上傳分享的文檔內(nèi)容本身不做任何修改或編輯，并不能對(duì)任何下載內(nèi)容負(fù)責(zé)。
  • 6. 下載文件中如有侵權(quán)或不適當(dāng)內(nèi)容，請(qǐng)與我們聯(lián)系，我們立即糾正。
  • 7. 本站不保證下載資源的準(zhǔn)確性、安全性和完整性, 同時(shí)也不承擔(dān)用戶因使用這些下載資源對(duì)自己和他人造成任何形式的傷害或損失。

最新文檔

評(píng)論

0/150

提交評(píng)論