數(shù)據(jù)綜合分析儀碼型發(fā)生模塊硬件設(shè)計.pdf_第1頁
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文檔簡介

1、隨著電子技術(shù)的飛速發(fā)展以及FPGA的廣泛應(yīng)用，數(shù)字產(chǎn)品越來越集成化、智能化、模塊化，功能也越來越復(fù)雜，數(shù)字產(chǎn)品應(yīng)用范圍的不斷拓寬使得用戶的需要不斷提升，從而對高速數(shù)字系統(tǒng)的測試工作也帶來了前所未有的挑戰(zhàn)，在測試過程中為了更快確定數(shù)字系統(tǒng)中的問題，需要更準(zhǔn)確的模擬被測設(shè)備的實際激勵，以得到更真實的激勵響應(yīng)。
　　碼型發(fā)生器作為數(shù)據(jù)發(fā)生器的一種，是一種重要的信號源。在硬件測試和軟件程序測試過程中，軟硬件工程師需要有生成數(shù)字激勵信號能力

2、的儀器用以仿真被測對象的激勵信號。碼型發(fā)生器的功用即產(chǎn)生所需要的各種數(shù)字激勵信號波形或時序。
　　基于碼型發(fā)生器的重要性，結(jié)合電子科技大學(xué)的科研項目“數(shù)據(jù)綜合分析儀”，本文圍繞碼型發(fā)生器模塊的發(fā)生過程展開研究，主要任務(wù)是產(chǎn)生多通道、高速率、深存儲深度、波形文件可編輯的碼型發(fā)生器模塊。本文結(jié)合碼型發(fā)生器模塊的技術(shù)特點，提出一套切實可行的解決方案，并在實際中得以驗證。
　　本論文主要工作包括：
　　簡述碼型發(fā)生器模塊波形的

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