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文檔簡介
1、本文采用理論分析和計算機仿真相結(jié)合的方法,在已有的理論基礎(chǔ)上詳細(xì)研究了LDPC碼的軟判決譯碼器和硬判決譯碼器的設(shè)計與實現(xiàn)的問題,主要完成的工作有以下幾個方面:1.介紹了易于FPGA實現(xiàn)的準(zhǔn)循環(huán)LDPC碼的結(jié)構(gòu)和特點,并對其提出了一個改進構(gòu)想.2.介紹并比較了軟判決譯碼的3種算法,從中選擇了一個收斂速度最快且需要的存儲量最少的算法作為軟判決譯碼器FPGA實現(xiàn)時采用的算法.使用Altera公司的Stratix EP1S25 FPGA芯片設(shè)計
2、了一個軟判決譯碼器,在主頻40M時最大吞吐量可以達(dá)到1G bit/s,若采用20次迭代,吞吐量可以達(dá)到50M bit/s,且在AWGN信道中,用BPSK調(diào)制,其性能與理論值基本相同.同時,給出了幾個可行的以降低芯片功耗和邏輯單元使用量為目的的改進方案.3.介紹了硬判決比特翻轉(zhuǎn)算法,提出了一個易于部分并行實現(xiàn)且性能沒有損失的確定閾值的方法,并將其與一個已有的簡化的比特翻轉(zhuǎn)算法進行比較,說明了它在譯碼速度上的優(yōu)勢.使用Altera公司的Cy
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