10bit 80MS-s流水線模數(shù)轉(zhuǎn)換器IP核的研究與設計.pdf_第1頁
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文檔簡介

1、隨著通信以及多媒體技術的迅速發(fā)展，系統(tǒng)級芯片成為了當前發(fā)展的潮流，高精度高速模數(shù)轉(zhuǎn)換器成為了系統(tǒng)級芯片設計中的一個關鍵技術。其中流水線結(jié)構(gòu)模數(shù)轉(zhuǎn)換器由于在速度、精度以及功耗方面可以實現(xiàn)很好的折中，非常適合應用于無線通信、HDTV(High Definition TV)、圖像識別等領域。
　　本文基于 SMIC0.18um Mix-signal1P6M with MIM工藝研究設計了一款10bit80MS/s流水線模數(shù)轉(zhuǎn)換器 IP核

2、，電源電壓為1.8V。主要工作包括：
　　(1)研究了流水線模數(shù)轉(zhuǎn)換器的基本工作原理，分析了流水線模數(shù)轉(zhuǎn)換器各種非理想因素、討論了一些低功耗技術以及系統(tǒng)架構(gòu)選擇的因素。
　　(2)確定了本款10bit80MS/s流水線 ADC的架構(gòu)為：前端采用采樣保持電路，后面1~8級流水級為1.5bit/stage結(jié)構(gòu)，第9級為2bitflashADC；同時為了降低功耗，采用了運放性能以及電容大小逐級縮減以及相鄰流水級運放共享技術；采用數(shù)

3、字校正算法減小比較器失調(diào)帶來的影響。
　　(3)設計了柵壓自舉開關，在80MHz的采樣頻率下 SFDR為72.5dB；設計了增益自舉折疊共源共柵運算放大器，其增益以及建立時間滿足要求并且留了比較多的設計裕量；設計了功耗較小的動態(tài)比較器，速度快并且失調(diào)電壓并未超出數(shù)字校正的范圍；設計了高速穩(wěn)定的片上參考電壓以及基準電流產(chǎn)生電路。
　　(4)完成了芯片的版圖設計并進行了流片與測試。
　　測試結(jié)果表明，芯片工作于80MHz采

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