2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題（含答案詳解+作文范文）_第1頁(yè)
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1、分頻器作為電子系統(tǒng)中常處于高頻段工作的基本模塊，在頻率綜合器、正交信號(hào)生成、時(shí)鐘產(chǎn)生、數(shù)據(jù)恢復(fù)以及高頻光纖通信系統(tǒng)中得到廣泛應(yīng)用，分頻器的工作狀態(tài)常常成為高速電子系統(tǒng)工作的瓶頸之一，其特性往往對(duì)電子系統(tǒng)性能也有決定性的影響。
　　論文設(shè)計(jì)的多模分頻器主要采用九級(jí)級(jí)聯(lián)的除2/除3單元構(gòu)成。除2/除3模塊的主要單元是高速觸發(fā)器，在綜合考慮設(shè)計(jì)中速度、面積和功耗的要求后，選擇在頻率較高處采用MOS電流模邏輯（Mos Current Mo

2、de Logic，MCML）結(jié)構(gòu)，在頻率較低處采用真單相時(shí)鐘（True Single Phase Clock，TSPC）結(jié)構(gòu)。針對(duì)除2/除3單元具有模塊化、易于優(yōu)化功耗，但實(shí)現(xiàn)分頻比范圍有限的缺點(diǎn)，通過(guò)添加適當(dāng)?shù)拈T級(jí)和輸出級(jí)電路，擴(kuò)寬了分頻比范圍，使其既能實(shí)現(xiàn)高速、低功耗的性能指標(biāo)，也能實(shí)現(xiàn)寬分頻比。
　　論文基于CSMC0.5mCMOS工藝，工作的電源電壓為2.5V,加載輸入頻率為0.5GHz~3GHz范圍的時(shí)鐘信號(hào)時(shí)，用Cad

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