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1、6.20指出用一塊或多塊74x138或74x139二進制譯碼器以及與非門,如何構(gòu)建下面每個單輸出或多輸出的邏輯功能(提示:每個實現(xiàn)等效于一個最小項之和)。解:a)??ZYXF)742(b)????CBACBAF)210()76543(c)??DCBAF)121020(或e)??YXWF)5420(??YXWG)6321(f)??CBAF)62(??EDCG)320(6.21圖X521電路有什么可怕的錯誤?提出消除這個錯誤的方法。解:該電
2、路中兩個24譯碼器同時使能,會導(dǎo)致2個3態(tài)門同時導(dǎo)通,出現(xiàn)邏輯電平?jīng)_突。為解決這一問題,在EN_L至1G(或2G)的線路上加一個反相器,使兩路門不可能同時導(dǎo)通。6.29二進制加法器的和的第3個數(shù)位S2為輸入x0、x1、x2、y0、y1、y2的函數(shù),試寫出它的代數(shù)表達式:假設(shè)c0=0,不要試圖“乘開”或最小化表達式。解:00000001)(yxcyxyxc???????001111111112)()(yxyxyxcyxyxc???????
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