窄帶LDPC解碼-誤碼測試實驗平臺設(shè)計.pdf_第1頁
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文檔簡介

1、本論文首先介紹并討論了數(shù)字電視傳輸標(biāo)準(zhǔn)TDS-OFDM的實現(xiàn)原理，對其中的一些關(guān)鍵問題做了詳細的分析，在此基礎(chǔ)上提出了一種基于FPGA的窄帶LDPC解碼-誤碼測試平臺設(shè)計方案，即利用時域PN頭同步及頻域?qū)ьl進行功率估計的FPGA設(shè)計。 根據(jù)窄帶LDPC解碼-誤碼測試平臺實現(xiàn)的功能，本文提出了它的系統(tǒng)設(shè)計框圖，將其劃分為若干模塊。在對每一個模塊的設(shè)計要點做了詳細說明之后，采用Verilog語言編寫各模塊邏輯代碼，在Altera公司

2、的QuartusⅡ5.0集成開發(fā)環(huán)境下，基于Altera公司Stratix系列FPGA對各模塊及整個窄帶LDPC解碼-誤碼測試平臺進行了仿真并將發(fā)端和收端的verilog程序分別下載到Altera的EP1S25F780C和EP1S80B956C6開發(fā)實驗板進行調(diào)試。仿真結(jié)果表明該設(shè)計能夠?qū)φ`碼率進行統(tǒng)計。 本文中的設(shè)計是一個簡化版本的OFDM數(shù)字電視傳輸系統(tǒng)。由于數(shù)字電視傳輸系統(tǒng)是一個復(fù)雜龐大的工程，為了驗證數(shù)字電視傳輸系統(tǒng)中L

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