2023年全國(guó)碩士研究生考試考研英語一試題真題（含答案詳解+作文范文）_第1頁(yè)
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文檔簡(jiǎn)介

1、該文著重討論了微處理器中占整體功耗比重最大的模塊之一—片上高速緩沖存儲(chǔ)器(Cache)-的低功耗設(shè)計(jì)方法.首先介紹了所設(shè)計(jì)的8KB四路組相聯(lián)Cache的整體電路結(jié)構(gòu)和讀寫時(shí)序.在滿足嵌入式RISC處理器的速度要求的基礎(chǔ)上,該文提出了一種串行訪問Tag/Data SRAM的方式來降低微處理器的組相聯(lián)Cache的功耗.在串行訪問Tag/Data SRAM以降低Cache訪問功耗的基礎(chǔ)上,該文還設(shè)計(jì)了省略Tag查找的指令Cache來進(jìn)一步降低

2、指令Cache的訪問功耗.接著,詳細(xì)介紹了對(duì)組相聯(lián)Cache在速度和功耗上優(yōu)化的電路級(jí)實(shí)現(xiàn)方案,包括一種新的電流靈敏放大器電路、分裂式動(dòng)態(tài)Tag比較器電路等高速電路模塊,同時(shí)還采用自定時(shí)技術(shù)實(shí)現(xiàn)了SRAM的自定時(shí)讀寫操作,自定時(shí)技術(shù)能夠有效降低工藝以及環(huán)境條件對(duì)電路的影響,還能夠有效地降低靜態(tài)存儲(chǔ)器陣列的讀寫功耗.在SMIC0.18um CMOS 工藝下,該文具體設(shè)計(jì)了一個(gè)32位RISC微處理器的8KB四路組相聯(lián)的指令Cache模塊和數(shù)

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