低功耗短距無(wú)線收發(fā)機(jī)中基帶控制電路的設(shè)計(jì).pdf_第1頁(yè)
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1、無(wú)線射頻低功耗收發(fā)機(jī)包括基帶控制器、射頻模擬前端、存儲(chǔ)器三大部分。其中基帶控制器不僅需要處理射頻前端接收到的信息或?qū)?shù)據(jù)打包通過(guò)射頻前端進(jìn)行發(fā)送,還需要與接口電路完成與外界的數(shù)據(jù)交換。因此基帶控制器是無(wú)線射頻低功耗收發(fā)機(jī)最重要的核心部件。
　　設(shè)計(jì)了一種具有高數(shù)據(jù)處理速率、低功耗、安全性好等特點(diǎn)的基帶控制電路,其可實(shí)現(xiàn)SPI通信和多種收發(fā)功能操作,該電路最終應(yīng)用于一種工作在780MHz頻段收發(fā)速率最高為2Mbps的無(wú)線射頻低功耗收

2、發(fā)機(jī)芯片中。
　　針對(duì)無(wú)線射頻低功耗收發(fā)機(jī)芯片的特點(diǎn),描述了芯片中基帶控制器的總體架構(gòu),并根據(jù)功能劃分為各個(gè)功能模塊,給出了接口電路、組幀電路、解幀電路以及核心控制處理器的設(shè)計(jì)思路、詳細(xì)結(jié)構(gòu)以及實(shí)現(xiàn)方法。使用 EDA工具實(shí)現(xiàn)了基帶控制器從數(shù)字前端到后端的完整的 ASIC流程設(shè)計(jì),并分別進(jìn)行了代碼功能仿真、FPGA功能驗(yàn)證、布局布線后時(shí)序仿真以及版圖后物理仿真。
　　電路采用中芯國(guó)際0.18μm CMOS工藝的設(shè)計(jì),基帶控制器

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