洗衣機(jī)控制電路設(shè)計(jì)eda課程設(shè)計(jì)

上傳人：奔*** IP屬地：河北更新時(shí)間：2024-03-01 格式：doc 頁數(shù)：26 大?。?08.50KB 人氣指數(shù)：12 舉報(bào) 版權(quán)申訴

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文檔簡介

1、　　數(shù)字電子技術(shù)　　課程設(shè)計(jì)報(bào)告　設(shè)計(jì)課題：洗衣機(jī)控制電路設(shè)計(jì)　學(xué)生姓名：　學(xué)生學(xué)號：　專業(yè)班級：08級自動(dòng)化1班

2、　學(xué)院名稱：電氣與信息工程學(xué)院　　一課程設(shè)計(jì)的目的：　　1、能夠全面鞏固和應(yīng)用“電子技術(shù)基礎(chǔ)數(shù)字部分”課程中所學(xué)的基本理論和方法，并初步掌握小型數(shù)字系統(tǒng)設(shè)計(jì)的基本方法。2、掌握VHDL語言編制小型模塊的方法，并采用層次化設(shè)計(jì)。　　3、培養(yǎng)電路設(shè)計(jì)能力，懂得理論設(shè)計(jì)與實(shí)物實(shí)現(xiàn)的有效結(jié)合。<

3、;/p>　　4、掌握Altium Designer軟件的應(yīng)用。　　二總體方案分析及選擇:　　洗衣機(jī)電路包含有總的控制模塊,洗滌控制模塊,洗滌記時(shí)模塊,電動(dòng)機(jī)控制模塊以及LCD液晶板的動(dòng)態(tài)顯示模塊.經(jīng)過分析后,我們把前四個(gè)模塊進(jìn)行組合,把他們合成一個(gè)模塊即:總控制模塊.他們之間的邏輯聯(lián)結(jié)關(guān)系，是對數(shù)電課程的一個(gè)很好總結(jié)，也是

4、自己對新知識（LCD液晶板的動(dòng)態(tài)顯示）學(xué)習(xí)理解運(yùn)用能力的一個(gè)很好的提升機(jī)會。　　三基本功能要求:　　要求設(shè)計(jì)制作一個(gè)普通功能洗衣機(jī)控制電路,使之能控制洗衣機(jī)的進(jìn)水閥,排水閥,洗滌程序電機(jī),甩干驅(qū)動(dòng)裝置等按預(yù)定程序工作.總體過程包括:進(jìn)水浸泡洗滌排水甩干五個(gè)過程.進(jìn)水從電路啟動(dòng)開始.其中浸泡可供選擇,洗滌時(shí)間可以預(yù)置,洗滌結(jié)束時(shí)發(fā)出鈴聲進(jìn)行

5、提示并自動(dòng)切斷電源.發(fā)生故障如:缺水或進(jìn)水超時(shí) 排水超時(shí) 甩干碰桶等時(shí)也可自動(dòng)切斷電源!　　根據(jù)洗衣機(jī)工作時(shí)不同的洗衣服數(shù)量，我們設(shè)計(jì)了三個(gè)檔（duoxi zhongxi shaoxi）來對洗衣機(jī)的進(jìn)水浸泡洗滌排水甩干的五個(gè)過程分別預(yù)置時(shí)間。以此來區(qū)分洗衣機(jī)不同洗衣數(shù)量下的工作狀態(tài)。　　用中小規(guī)模集成電路芯片或CPLD/FPGA設(shè)計(jì)符合上述任務(wù)要

6、求的電路,并制作出能實(shí)際運(yùn)行的裝置.　　安裝并調(diào)試電路,測試各部分電路功能或模型.　　演示并交驗(yàn)硬件裝置.　　下載實(shí)現(xiàn)圖:　　四總控制模塊的生成程序　　library ieee;</

7、p>　　use ieee.std_logic_1164.all;　　use ieee.std_logic_arith.all;　　use ieee.std_logic_unsigned.all;　　entity washer is<b&g

8、t;　　port(　　clk0, clk1, rst, alarm: in std_logic;　　-----clk0:控制開關(guān)脈沖.clk1:記時(shí)開關(guān)脈沖.Rst:復(fù)位端.alarm報(bào)警輸入端.-------　　duoxi,zhongxi,shaoxi : in std_Logic;<

9、/p>　　-----qiangxi:強(qiáng)洗輸入端。zhongxi:中洗輸入端。ruoxi：弱洗輸入端。-------------　　water_in, water_out, immersion, dry, z1, z2, voice, poweroff: out std_logic;　　-----進(jìn)水,出水,浸泡,甩干,洗滌,響

10、鈴,斷電輸出端-------　　display_th, display_tl: out std_logic_vector(3 downto 0)　　-------------------輸出時(shí)間顯示高位低位輸出端-------------　　);<

11、;p>　　end entity washer;　　architecture behave of washer is　　signal js, js_ten : std_logic;　　signal im, im_ten : std_logic;　　signal wa,

12、 wa_ten : std_logic;　　signal wa1, wa2, pwf: std_logic;　　signal cs, cs_ten : std_logic;　　signal dr, dr_ten : std_logic;　　signal xl, xl_te

13、n : std_logic;　　signal js_dh, js_dl: std_logic_vector(3 downto 0);　　signal im_dh, im_dl: std_logic_vector(3 downto 0);　　signal wa_dh, wa_dl: std_logic_vector

14、(3 downto 0);　　signal cs_dh, cs_dl: std_logic_vector(3 downto 0);　　signal dr_dh, dr_dl: std_logic_vector(3 downto 0);　　signal xl_dh, xl_dl: std_logic_vector(

15、3 downto 0);　　signal dis_th,dis_tl: std_logic_vector(3 downto 0);　　signal water_inh, water_inl, im_th, im_tl, wash_th: std_logic_vector(3 downto 0);　　signa

16、l wash_tl, water_outh, water_outl, dry_th, dry_tl: std_logic_vector(3 downto 0);　　begin　　-----------------------控制:控制器件實(shí)現(xiàn)洗衣機(jī)的功能:進(jìn)水->浸水->洗滌->出水->甩

17、干　　control:process(clk0, rst,alarm,duoxi,zhongxi,shaoxi)　　variable n: integer;　　begin　　if duoxi='1' and zhong

18、xi='0' and shaoxi='0' then　　water_inh<="0001";　　water_inl<="0010";　　im_th<="1001";

19、;　　im_tl<="0000";　　wash_th<="1001";　　wash_tl<="0000";　　water_outh<="0001";　　water_ou

20、tl<="0010";　　dry_th<="1001";　　dry_tl<="0000";　　elsif duoxi='0' and zhongxi='1' and shaoxi='0'

21、; then　　water_inh<="0000";　　water_inl<="0110";　　im_th<="0110";　　im_tl<="0000";</p

22、>　　wash_th<="0110";　　wash_tl<="0000";　　water_outh<="0000";　　water_outl<="0110";

23、　　dry_th<="0110";　　dry_tl <="0000";　　elsif duoxi='0' and zhongxi='0' and shaoxi='1' then　　water

24、_inh<="0000";　　water_inl<="0110";　　im_th<="0011";　　im_tl<="0000";　　wash_th<="

25、;0011";　　wash_tl<="0000";　　water_outh<="0000";　　water_outl<="0110";　　dry_th<="0011&q

26、uot;;　　dry_tl <="0000";　　else　　water_inh<="0000";　　water_inl<="0000";

27、;　　im_th<="0000";　　im_tl<="0000";　　wash_th<="0000";　　wash_tl<="0000";　　wa

28、ter_outh<="0000";　　water_outl<="0000";　　dry_th<="0000";　　dry_tl <="0000";

29、end if;　　if alarm = '1' then　　pwf <= '1';　　else　　if rst = '1' then&l

30、t;p>　　n := 0;　　im_ten <= '0';　　js_ten <= '0';　　wa_ten <= '0';　　cs_ten <= '

31、0';　　dr_ten <= '0';　　xl_ten <= '0';　　pwf <= '0';　　elsif clk0 = '1' and clk0 'event then

32、　　if n = 0 then　　if water_inh = "0000" and water_inl = "0000" then　　n := 1;　　else</b&

33、gt;　　js_ten <= '1';　　if js = '1' then　　n := 1;　　end if;<

34、;b>　　end if;　　elsif js = '0' and n = 1 then　　if im_th = "0000" and im_tl = "0000" then　　n := 2;&l

35、t;/p>　　else　　im_ten <= '1';　　if im = '1' then　　n := 2;

36、end if;　　end if;　　elsif im = '0' and n = 2 then　　if wash_th = "0000" and wash_tl = "0000" then</p

37、>　　n := 3;　　else　　wa_ten <= '1';　　if wa = '1' then　　n :=

38、 3;　　end if;　　end if;　　elsif wa = '0' and n = 3 then　　if water_outh = "0000

39、" and water_outl = "0000" then　　n := 4;　　else　　cs_ten <= '1';　　if cs = &

40、#39;1' then　　n := 4;　　end if;　　end if;　　elsif cs = '0' and n = 4 th

41、en　　if dry_th = "0000" and dry_tl = "0000" then　　n := 5;　　else　　dr_ten <= &

42、#39;1';　　if dr = '1' then　　n := 5;　　end if;　　end if;<

43、;p>　　elsif dr = '0' and n = 5 then　　xl_ten <= '1';　　if xl = '1' then　　n := 6;

44、　end if;　　elsif xl = '0' and n = 6 then　　pwf <= '1';　　end if;　　end if;

45、;　　end if;　　end process;　　-----------------------------記時(shí)-----------------------------　　------------------進(jìn)水記時(shí)-------

46、-------------------　　js_jishiqi:process(clk1, js_ten,water_inh,water_inl)　　begin　　if js_ten = '0' then　　js_dh

47、 <= water_inh;　　js_dl <= water_inl;　　js <= '0';　　elsif clk1 = '1' and clk1 'event then　　if js_dh = "00

48、00" and js_dl = "0000" then　　js <= '0';　　else　　js <= '1';　　if js_dl = "0000

49、" then　　js_dl <= "1001";　　js_dh <= js_dh - 1;　　else　　js_dl <= js_dl - 1;

50、　　end if;　　end if;　　end if;　　end process;　　-------------浸泡記時(shí)-------------------

51、----　　im_jishiqi:process(clk1, im_ten,im_th,im_tl)　　begin　　if im_ten = '0' then　　im_dh <= im_th;

52、　　im_dl <= im_tl;　　im <= '0';　　elsif clk1 = '1' and clk1 'event then　　if im_dh = "0000" and im_dl = "0000

53、" then　　im <= '0';　　else　　im <= '1';　　if im_dl = "0000" then

54、;　　im_dl <= "1001";　　im_dh <= im_dh - 1;　　else　　im_dl <= im_dl - 1;　　end if;<

55、;/p>　　end if;　　end if;　　end process;　　-----------------洗滌記時(shí)----------------------　　w

56、a_jishiqi:process(clk1, wa_ten,wash_th,wash_tl)　　variable m: integer;　　begin　　if wa_ten = '0' then　　wa_dh <

57、;= wash_th;　　wa_dl <= wash_tl;　　wa <= '0';　　wa1 <= '0';　　wa2 <= '0';

58、m := 0;　　elsif clk1 = '1' and clk1 'event then　　if wa_dh = "0000" and wa_dl = "0000" then　　wa <= '0';<

59、;/p>　　wa1 <= '0';　　wa2 <= '0';　　else　　wa <= '1';　　if m = 0 then</p&

60、gt;　　wa1 <= '1';　　wa2 <= '1';　　elsif m = 10 then　　wa1 <= '0';　　wa2 <= '1';</p&

61、gt;　　elsif m = 13 then　　wa1 <= '1';　　wa2 <= '0';　　elsif m = 23 then　　wa1 <= '0';

62、　　wa2 <= '0';　　elsif m = 26 then　　m := 0;　　wa1 <= '1';　　wa2 <= '1';</p&g

63、t;　　end if;　　m := m + 1;　　if wa_dl = "0000" then　　wa_dl <= "1001";　　wa_dh <= wa_

64、dh - 1;　　else　　wa_dl <= wa_dl - 1;　　end if;　　end if;<

65、;b>　　end if;　　end process;　　--------------出水記時(shí)---------------------------　　cs_jishiqi:process(clk1, cs_ten,water_outh,water_outl)<

66、;p>　　begin　　if cs_ten = '0' then　　cs_dh <= water_outh;　　cs_dl <= water_outl;　　cs <= '0';&

67、lt;/p>　　elsif clk1 = '1' and clk1 'event then　　if cs_dh = "0000" and cs_dl = "0000" then　　cs <= '0';

68、　　else　　cs <= '1';　　if cs_dl = "0000" then　　cs_dl <= "1001";　　cs_dh <= cs_dh - 1

69、;　　else　　cs_dl <= cs_dl - 1;　　end if;　　end if;

70、　　end if;　　end process;　　--------------甩干記時(shí)-----------------------　　dr_jishiqi:process(clk1, dr_ten,dry_th,dry_tl)　　b

71、egin　　if dr_ten = '0' then　　dr_dh <= dry_th;　　dr_dl <= dry_tl;　　dr <= '0';　　elsi

72、f clk1 = '1' and clk1 'event then　　if dr_dh = "0000" and dr_dl = "0000" then　　dr <= '0';　　else&

73、lt;/p>　　dr <= '1';　　if dr_dl = "0000" then　　dr_dl <= "1001";　　dr_dh <= dr_dh - 1;<

74、b>　　else　　dr_dl <= dr_dl - 1;　　end if;　　end if;　　end if;</p&

75、gt;　　end process;　　------------------響鈴記時(shí)----------------------　　xl_jishiqi:process(clk1, xl_ten)　　begin

76、if xl_ten = '0' then　　xl_dh <= "0010";　　xl_dl <= "0000";　　xl <= '0';　　elsif clk1 = '1&#

77、39; and clk1 'event then　　if xl_dh = "0000" and xl_dl = "0000" then　　xl <= '0';　　else<p&

78、gt;　　xl <= '1';　　if xl_dl = "0000" then　　xl_dl <= "1001";　　xl_dh <= xl_dh - 1;　　else</b

79、>　　xl_dl <= xl_dl - 1;　　end if;　　end if;　　end if;　　e

80、nd process;　　----------------------------顯示時(shí)間--------------------------　　xianshishijian: process(clk1, js_ten, im_ten, wa_ten,cs_ten,dr_ten,xl_ten)

81、　begin　　if js_ten = '1' and im_ten = '0' and wa_ten = '0' and cs_ten = '0' and dr_ten = '0' and xl_ten = '0' then　　if cl

82、k1 = '1' and clk1 'event then　　dis_th <= js_dh;　　dis_tl <= js_dl;　　end if;　　elsif im_ten = '1&#

83、39; and wa_ten = '0' and cs_ten = '0' and dr_ten = '0' and xl_ten = '0' then　　if clk1 = '1' and clk1 'event then　　dis_th <= im_dh;&

84、lt;/p>　　dis_tl <= im_dl;　　end if;　　elsif wa_ten = '1' and cs_ten = '0' and dr_ten = '0' and xl_ten = '0' then&

85、lt;/p>　　if clk1 = '1' and clk1 'event then　　dis_th <= wa_dh;　　dis_tl <= wa_dl;　　end if;<p&g

86、t;　　elsif cs_ten = '1' and dr_ten = '0' and xl_ten = '0' then　　if clk1 = '1' and clk1 'event then　　dis_th <= cs_dh;　　d

87、is_tl <= cs_dl;　　end if;　　elsif dr_ten = '1' and xl_ten = '0' then　　if clk1 = '1' and clk1 'event then</

88、p>　　dis_th <= dr_dh;　　dis_tl <= dr_dl;　　end if;　　elsif xl_ten = '1' then　　if clk1 = '

89、1' and clk1 'event then　　dis_th <= xl_dh;　　dis_tl <= xl_dl;　　end if;　　end if;</p&

90、gt;　　end process;　　----------------------------輸出-----------------------------　　output:process(dis_th, dis_tl, im, js, cs, dr, wa1, wa2, xl, pwf)&

91、lt;b>　　begin　　display_th <= dis_th;　　display_tl <= dis_tl;　　immersion <= im;　　water_in <= js;<p&

92、gt;　　water_out <= cs;　　dry <= dr;　　z1 <= wa1;　　z2 <= wa2;　　voice <= xl;　　poweroff <= pwf;</p&g

93、t;　　end process;　　end behave;　　測試文件：　　------------------------------------------------------------　　-- VH

95、----------------------------------------------------------　　Library IEEE;　　Use IEEE.std_logic_1164.all;　　Use IEEE.std_logic_textio.all;&l

96、t;p>　　Use STD.textio.all;　　------------------------------------------------------------　　------------------------------------------------------------

97、　entity Testwasher is　　end Testwasher;　　------------------------------------------------------------　　-------------------------------------------------------

98、-----　　architecture stimulus of Testwasher is　　file RESULTS: TEXT open WRITE_MODE is "results.txt";　　procedure WRITE_RESULTS(

99、　alarm: std_logic;　　clk0: std_logic;　　clk1: std_logic;　　display_th: std_logic_vector(3 downto 0);　　display_tl: std_logic_vector(3 downto

100、 0);　　dry: std_logic;　　duoxi: std_logic;　　immersion: std_logic;　　poweroff: std_logic;　　rst: std_logic;&

101、lt;p>　　shaoxi: std_logic;　　voice: std_logic;　　water_in: std_logic;　　water_out: std_logic;　　z1: std_logic;　　z2: s

102、td_logic;　　zhongxi: std_logic　　) is　　variable l_out : line;　　begin　　write(l_o

103、ut, now, right, 15);　　write(l_out, alarm, right, 2);　　write(l_out, clk0, right, 2);　　write(l_out, clk1, right, 2);　　write(l_out, display

104、_th, right, 5);　　write(l_out, display_tl, right, 5);　　write(l_out, dry, right, 2);　　write(l_out, duoxi, right, 2);　　write(l_out, immersi

105、on, right, 2);　　write(l_out, poweroff, right, 2);　　write(l_out, rst, right, 2);　　write(l_out, shaoxi, right, 2);　　write(l_out, voice, ri

106、ght, 2);　　write(l_out, water_in, right, 2);　　write(l_out, water_out, right, 2);　　write(l_out, z1, right, 2);　　write(l_out, z2, right, 2)

107、;　　write(l_out, zhongxi, right, 2);　　writeline(RESULTS, l_out);　　end procedure;　　component washer　　port (&

108、lt;/b>　　alarm: in std_logic;　　clk0: in std_logic;　　clk1: in std_logic;　　display_th: out std_logic_vector(3 downto 0);<

109、p>　　display_tl: out std_logic_vector(3 downto 0);　　dry: out std_logic;　　duoxi: in std_logic;　　immersion: out std_logic;　　poweroff: ou

110、t std_logic;　　rst: in std_logic;　　shaoxi: in std_logic;　　voice: out std_logic;　　water_in: out std_logic;　　water_out

111、: out std_logic;　　z1: out std_logic;　　z2: out std_logic;　　zhongxi: in std_logic　　);　　end compone

112、nt;　　signal alarm: std_logic;　　signal clk0: std_logic;　　signal clk1: std_logic;　　signal display_th: std_logic_vector(3 downto 0);</p&

113、gt;　　signal display_tl: std_logic_vector(3 downto 0);　　signal dry: std_logic;　　signal duoxi: std_logic;　　signal immersion: std_logic;&

114、lt;p>　　signal poweroff: std_logic;　　signal rst: std_logic;　　signal shaoxi: std_logic;　　signal voice: std_logic;　　signal water_in: std

115、_logic;　　signal water_out: std_logic;　　signal z1: std_logic;　　signal z2: std_logic;　　signal zhongxi: std_logic;<

116、b>　　begin　　DUT:washer port map (　　alarm => alarm,　　clk0 => clk0,　　clk1 => clk1,　　display_th =

117、> display_th,　　display_tl => display_tl,　　dry => dry,　　duoxi => duoxi,　　immersion => immersion,　　pow

118、eroff => poweroff,　　rst => rst,　　shaoxi => shaoxi,　　voice => voice,　　water_in => water_in,　　water_ou

119、t => water_out,　　z1 => z1,　　z2 => z2,　　zhongxi => zhongxi　　);</p

120、>　　STIMULUS0:process　　begin　　-- insert stimulus here　　alarm <= '0';　　duoxi<='0';&

121、lt;/p>　　zhongxi<='1';　　shaoxi<='0' ;　　rst <= '1';　　wait for 10ns;　　rst <= '0'

122、;　　wait for 1000ns;　　alarm <= '1';　　wait;　　end process;　　process&l

123、t;/p>　　begin　　clk0 <= '1';　　clk1 <= '1';　　wait for 1ns;　　clk0 <= '0';&

124、lt;/p>　　clk1 <= '0';　　wait for 1ns;　　end process;　　WRITE_RESULTS(　　alarm,<p&g

125、t;　　clk0,　　clk1,　　display_th,　　display_tl,　　dry,

126、　duoxi,　　immersion,　　poweroff,　　rst,　　shaoxi,<

127、;b>　　voice,　　water_in,　　water_out,　　z1,　　z2,&

128、lt;b>　　zhongxi　　);　　end architecture;　　------------------------------------------------------------　　生成的

129、器件和仿真波形：　　顯示模塊生成程序：　　LIBRARY IEEE;　　USE IEEE.std_Logic_1164.ALL;　　ENTITY OUTPUT IS　　POR

130、T　　(R, CP, BUSY :IN Std_Logic;-----使能輸入端,脈沖輸入端,輸入信號忙輸入端--------　　LINE_OUT,STROBE,RST:OUT STD_LOGIC;------行選擇輸出端,輸入數(shù)據(jù)使能輸出端,復(fù)位輸出端---　　TIME_IN :IN STD

131、_LOGIC_VECTOR(7 DOWNTO 0);--------輸入時(shí)間-----------　　ADDR_OUT :OUT Std_Logic_Vector( 3DOWNTO 0);--------地址輸出端----------　　DATA_OUT : OUT Std_Logic_Vector(7 DOWNTO 0));-----數(shù)據(jù)輸出端----

132、-----　　END OUTPUT;　　ARCHITECTURE XS OF OUTPUT IS　　TYPE State_type IS(S0,S1,S2,S3,S4);　　SIGNAL S :State_Type;　　SIGNA

133、L LCDPT:INTEGER RANGE 0 TO 14;　　BEGIN　　PROCESS(CP,R)　　BEGIN　　IF R='1' THEN<

134、p>　　S<=S0;LCDPT<=0;RST<='1';　　ELSIF CP='1' AND CP 'EVENT THEN　　CASE S IS　　WHEN S0=> S<=S1;LCDPT<=

135、0;RST<='1';　　WHEN S1=> RST<='0';STROBE<='0';　　IF BUSY='0' THEN　　LCDPT<=LCDPT+1;　　IF LCDPT

136、=15 THEN　　S<=S3;　　ELSE　　S<=S2;　　END IF;<

137、;p>　　END IF;　　WHEN S2=> S<=S1;STROBE<='1';　　WHEN S3=> STROBE<='0';　　IF BUSY='0' THEN

138、　　IF LCDPT=16 THEN　　LCDPT<=15;　　ELSE　　LCDPT<=LCDPT+1;　　END IF;

139、　　S<=S4;　　END IF;　　WHEN S4=> STROBE<='1';S<=S3;　　WHEN OTHERS=> NULL;<b&g

140、t;　　END CASE;　　END IF;　　END PROCESS;　　PROCESS (LCDPT,TIME_IN)　　BEGIN

141、;　　CASE LCDPT IS　　WHEN 0 => NULL;　　WHEN 1 => DATA_OUT<="01010111" ; ADDR_OUT<="0000"; LINE_OUT<='0';　　WHEN 2 =>

142、 DATA_OUT<="01000001" ; ADDR_OUT<="0001"; LINE_OUT<='0';　　WHEN 3 => DATA_OUT<="01010011" ; ADDR_OUT<="0010"; LINE_OUT<='0'

143、;　　WHEN 4 => DATA_OUT<="01001000" ; ADDR_OUT<="0011"; LINE_OUT<='0';　　WHEN 5 => DATA_OUT<="01000101" ; ADDR_OUT<="

144、0100"; LINE_OUT<='0';　　WHEN 6 => DATA_OUT<="01010010" ; ADDR_OUT<="0101"; LINE_OUT<='0';　　WHEN 7 => DATA_OUT<="

145、01001111" ; ADDR_OUT<="0111"; LINE_OUT<='0';　　WHEN 8 => DATA_OUT<="01000110" ; ADDR_OUT<="1000"; LINE_OUT<='0';<p&g

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洗衣機(jī)控制電路設(shè)計(jì)eda課程設(shè)計(jì)

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