eda課程設(shè)計(jì)-簡(jiǎn)易信號(hào)發(fā)生器

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文檔簡(jiǎn)介

1、　　簡(jiǎn)易信號(hào)發(fā)生器 　　課程設(shè)計(jì)要求　　1. 完成實(shí)驗(yàn)板上DAC的匹配電阻選擇、焊接與調(diào)試，確保其可以正常工作。　　2. 根據(jù)直接數(shù)字頻率合成（DDFS）原理設(shè)計(jì)正弦信號(hào)發(fā)生器，頻率步進(jìn)1Hz，最高輸出頻率不限

2、，在波形不產(chǎn)生失真（從輸出1KHz正弦轉(zhuǎn)換為輸出最高頻率正弦時(shí)，幅度衰減不得大于10%）的情況下越高越好。頻率字可以由串口設(shè)定，也可以由按鍵控制，數(shù)碼管上顯示頻率值。　　3. 可以控制改變輸出波形類(lèi)型，在正弦、三角波、鋸齒波、方波之間切換。　　4. 輸出波形幅度可調(diào)，最小幅度步進(jìn)100mV。　　直接數(shù)字頻率合成（

3、DDS）原理　　直接數(shù)字頻率合成技術(shù)是根據(jù)相位間隔對(duì)正弦信號(hào)進(jìn)行取樣、量化、編碼，然后儲(chǔ)存在EPROM中構(gòu)成一個(gè)正弦查詢表。頻率合成時(shí)，相位累加器在參考時(shí)鐘的作用下對(duì)時(shí)鐘脈沖進(jìn)行計(jì)數(shù)，同時(shí)將累加器輸出的累加相位與頻率控制字K預(yù)置的相位增量相加，以相加后的吉果形成正弦查詢表的地址；取出表中與該相位對(duì)應(yīng)的單元中的幅度量化正弦函數(shù)值，經(jīng)D／A轉(zhuǎn)換器輸出模擬信號(hào)，再經(jīng)低通濾波器平滑得到符合要求的模擬信號(hào)

4、。相位累加器的最大計(jì)數(shù)長(zhǎng)度與正弦查詢表中所存儲(chǔ)的相位分隔點(diǎn)數(shù)相同，由于相位累加器的相位增量不同，將導(dǎo)致一周期內(nèi)的取樣點(diǎn)數(shù)不同，在取樣頻率(由參考時(shí)鐘頻率決定)不變的情況下，輸出信號(hào)的頻率也相應(yīng)變化。　　fin=M(fclk/2^n)　　系統(tǒng)設(shè)計(jì)　　總體設(shè)計(jì)方

5、案　　信號(hào)發(fā)生器從總體上可以分為系統(tǒng)控制模塊，波形產(chǎn)生模塊和D/A轉(zhuǎn)換模塊。　　系統(tǒng)控制模塊負(fù)責(zé)處理按鍵的讀入，按鍵處理，將頻率和幅度在數(shù)碼管上顯示，調(diào)節(jié)頻率和幅度以及波形的選擇。　　波形發(fā)生模塊負(fù)責(zé)按照控制模塊輸入的信號(hào)，輸出相應(yīng)的波形（正弦波，方波鋸，齒波，三角波），以及輸出相應(yīng)幅度和頻率

6、的信號(hào)。　　D/A轉(zhuǎn)換模塊負(fù)責(zé)將輸入的數(shù)字信號(hào)轉(zhuǎn)換為模擬信號(hào)。　　3.2 系統(tǒng)控制模塊　　按鍵控制模塊和數(shù)碼顯示模塊　　1）、按鍵讀取模塊設(shè)計(jì)思路：由于按鍵按下時(shí)有一段時(shí)間的低電平，而按下時(shí)A、B、C、D的輸入鍵值始終是高電平，故可以通過(guò)在20M時(shí)鐘的每個(gè)上升沿來(lái)檢測(cè)按鍵

7、輸入端的電平變化，經(jīng)過(guò)消抖后就可以判斷是哪個(gè)按鍵按下。　　按鍵檢測(cè)和按鍵值讀取的主要進(jìn)程：　　process(clk_key)　　variable counter: std_logic_vector(15 downto 0);　　variable state:intege

8、r range 4 downto 0;　　begin　　if rising_edge(clk_key)then　　case state is　　when 0 => if (abcd(0)='0' or abcd(

9、1)='0' or abcd(2)='0'or abcd(3)='0') then 　　state:=1;　　else state:=0;　　end if;<p

10、>　　when 1 => if counter>="1111111111111110" then　　state:=2;　　counter:="0000000000000000";　　else counter:=coun

11、ter+1;　　state:=1;　　end if;　　when 2 => if abcd(0)='0' or abcd(1)='0' or abcd(2)='0'or abcd(3)

12、='0' then　　case abcd is　　when "0111"=>key_value_1<="00";state:=3;　　when "1011"=>key_value_1<="01"

13、;state:=3;　　when "1101"=>key_value_1<="10";state:=3;　　when "1110"=>key_value_1<="11";state:=3;　　when othe

14、rs=>state:=0;　　end case;　　else state:=0;　　end if;　　when 3 => if (abcd(0)='0' or abcd

15、(1)='0' or abcd(2)='0'or abcd(3)='0')then　　if counter>="0000000000000011"then 　　counter:="0000000000000000";out_clk<='1'

16、;　　else counter:=counter+1;　　end if;　　state:=3;　　else <

17、b>　　state:=4;　　out_clk<='1';　　end if;　　when 4 => if counter>="0000000000000111" then&l

18、t;p>　　state:=0;　　counter:="0000000000000000";out_clk<='0';　　else counter:=counter+1;　　state:=4;

19、　　end if;　　end case;　　end if;　　end process;　　2）、按鍵處理和顯示模塊設(shè)

20、計(jì)思路　　外接的四個(gè)按鍵的分配：　　A：數(shù)碼管頻率顯示和幅度顯示切換；　　B：波形之間的切換（用四個(gè)LED對(duì)應(yīng)顯示）；　　C：選擇要調(diào)節(jié)的數(shù)碼管（用四個(gè)LED對(duì)應(yīng)顯示）；　　D：對(duì)選擇的數(shù)碼管進(jìn)行調(diào)節(jié)（0~9循環(huán)顯示）；</

21、p>　　數(shù)碼管顯示：從左往右依次是頻率(單位Hz)或幅度（mV）值的千、百、十、個(gè)位。　　LED燈顯示：左邊四位是作為要調(diào)節(jié)的數(shù)碼管的指示　　右邊四位是作為輸出波形的指示　　3.3 波形產(chǎn)生模塊　　圖表 1信號(hào)發(fā)生模塊RTL圖

22、;　　正弦波的產(chǎn)生　　我們根據(jù)DDS算法，將根據(jù)控制信號(hào)輸入的頻率數(shù)值fin，我們?cè)O(shè)置了一個(gè)25位的計(jì)數(shù)器，da初值為A。　　這樣da的高八位da(24:17)會(huì)每隔一定的時(shí)間t加1，這就可以作為時(shí)鐘信號(hào)　　data= da(24:17)，它會(huì)從1加到2

23、55，這就可以作為rom的地址信號(hào)不斷的重復(fù)讀取rom中的正弦信號(hào)的數(shù)值，這就產(chǎn)生了正弦信號(hào)的數(shù)字信號(hào)。　　由以上的data也可以作為三角波，鋸齒波，矩形波的時(shí)鐘信號(hào)，每個(gè)時(shí)間t產(chǎn)生一個(gè)信號(hào)，這樣信號(hào)的每個(gè)周期讀取了256個(gè)數(shù)值。改變時(shí)間t也就可以改變信號(hào)的周期，我們可以通過(guò)改變輸入數(shù)值改變時(shí)間t：　　n=(131072-A)/fin (

24、fin為輸入頻率Hz)　　fclk=n*256 （fclk為時(shí)鐘頻率）　　這樣就可以計(jì)算出A的數(shù)值。　　三角波的產(chǎn)生　　由以上的data（0~255）我們可以設(shè)一個(gè)變量ds(0~255)，在data（0~255）<

25、127時(shí)加1，　　data（0~255）>127時(shí)減1，這樣就可以得出與正弦波相同頻率的三角波信號(hào)。　　鋸齒波的產(chǎn)生　　由以上的data（0~255）我們可以設(shè)一個(gè)變量dj(0~255)，在data（0~255）<255時(shí)加1， data（0~255）=255時(shí)變

26、為0，這樣就可以得出與正弦波相同頻率的鋸齒波。　　方波的產(chǎn)生　　由以上的data（0~255）我們可以設(shè)一個(gè)變量ds(0~255)，在data（0~255）<127時(shí)為255，data（0~255）>127時(shí)變?yōu)?，這樣就可以得出與正弦波相同頻率的矩形信號(hào)。　　3

27、.4 波形選擇模塊　　選用一個(gè)四選一的數(shù)據(jù)選擇器：　　3.5 幅度調(diào)節(jié)模塊　　由于輸出地信號(hào)最大為255，最小為0，而D/A轉(zhuǎn)換器的輸入范圍也是0~255，并且D/A轉(zhuǎn)換器沒(méi)有參考信號(hào)調(diào)節(jié)的地方，因此只能改變輸出的數(shù)字信號(hào)的大小。也就是在FPGA里面改變。

28、;　　這里有兩種方法：　　第一種就是在數(shù)據(jù)選擇器的輸出端加上一個(gè)除法器，將輸出信號(hào)除以33，平均0分為33份，然后再按照輸入幅度的控制信號(hào)乘以相應(yīng)的數(shù)。但這樣有個(gè)缺點(diǎn)，就是精度不夠高，這里的除法器時(shí)整數(shù)除法，無(wú)法進(jìn)行小數(shù)運(yùn)算，會(huì)是輸出數(shù)值減小很大。　　第二種方法就是預(yù)先將所有可能的數(shù)值先算好，存到FPGA里面根據(jù)當(dāng)前的輸出數(shù)值和要輸出

29、地幅度選擇已經(jīng)算好的數(shù)據(jù)。這樣處理起來(lái)速度快，精度高（因?yàn)檫@里預(yù)先采用浮點(diǎn)數(shù)計(jì)算），但缺點(diǎn)是占用資源大，好在FPGA資源夠用，我們采用第二種方法。　　程序如下：　　case fz1 is　　when 33=> dout1:=din1;<p

30、>　　when 32=> case din1 is　　when 255 => dout1:=247;　　when 254 => dout1:=246;　　……　　when others =>dout1:

31、= 0;　　end case;　　when 31=> case din1 is　　when 255 => dout1:=240;　　……&

32、lt;b>　　……　　When 0=> dout1:=0;　　end case;　　3.6 D/A轉(zhuǎn)換模塊　　這是一個(gè)同相求和運(yùn)算電路 　　根據(jù)公式u0=R

33、f(ui1/R1+ui2/R2+ui3/R3+…)，可以計(jì)算出　　R43=2*R44=4*R45=8*R46=16*R47=32*R48=64*R49=128*R50　　R43=2*R42　　因此可以選取<p

34、>　　R40=1 kΩ R41=1 kΩ R42=1 kΩ R43=2kΩ R44=4kΩ　　R45=8 kΩ R46=16 kΩ R47=32 kΩ R48=64 kΩ R49=128 kΩ　　R50=256 kΩ　　4 總結(jié)<

35、/p>　　通過(guò)本次EDA技術(shù)課程設(shè)計(jì)，我們掌握了系統(tǒng)的數(shù)字電子設(shè)計(jì)的方法，也知道了實(shí)驗(yàn)調(diào)試適配的具體操作方法，理解了綜合設(shè)計(jì)的基本方法。在設(shè)計(jì)過(guò)程中，我們遇到了各種問(wèn)題，在老師的指導(dǎo)下和我們自己的努力，互相合作，克服了各種問(wèn)題，最后取得了成功。但是本次設(shè)計(jì)還不是很成功的，由于時(shí)間比較短,我僅完成了所要求的功能,輸出信號(hào)的頻率范圍還不夠高，精度也不夠高。通過(guò)設(shè)計(jì)，提高了我們對(duì)EDA技術(shù)的認(rèn)識(shí).這個(gè)設(shè)計(jì)雖然很小,

36、但麻雀雖小,五臟具全,對(duì)我們這樣的初學(xué)者來(lái)說(shuō)不失為好的選擇。　　因?yàn)檫€可以再修改好一些，我想自己在以后的學(xué)習(xí)和工作中一定會(huì)更加努力，把知識(shí)充實(shí)好。最后再次感謝老師的指導(dǎo)和幫助。　　附錄：　　加法器產(chǎn)生時(shí)鐘信號(hào)程序：　　library

37、ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity adder32b is　　port (clk:in std_logic;

38、　a:in std_logic_vector(24 downto 0);　　s:out std_logic_vector(24 downto 0));　　end adder32b;　　architecture behav of adder32b is　　constant

39、db1:std_logic_vector:="01101001010111011";　　constant db2:std_logic_vector:="01101101010001011";　　begin 　　aa:process(cl

40、k)　　variable da:std_logic_vector(24 downto 0);　　variable dk1:std_logic;　　begin　　if clk'event and clk='1'

41、then　　dk1:=da(17);　　da:=da+a;　　if dk1/=da(17) then　　if a(13 downto 0)>"00101110111000" then&

42、lt;p>　　da(16 downto 0):=db2;　　else 　　da(16 downto 0):=db1;　　end if;　　end if;

43、　　end if;　　s<=da;　　end process;　　end behav;　　數(shù)據(jù)選擇器：<

44、/p>　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity mux41a is　　port (--clk:in std_l

45、ogic;　　a,b,c,d:in std_logic_vector(7 downto 0);　　s: in std_logic_vector(3 downto 0);　　dout:out std_logic_vector(7 downto 0)　　);

46、　　end mux41a;　　architecture behav of mux41a is　　signal da:std_logic_vector(7 downto 0);　　begin&

47、lt;p>　　process(s)　　begin　　case s is　　when "1110"=> da<=a;　　when "1101"

48、;=> da<=b;　　when "1011"=> da<=c;　　when "0111"=> da<=d;　　when others =>da<=a;　　end c

49、ase;　　end process;　　dout<=da;　　end behav;　　方波　　library ieee;<

50、/p>　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;　　entity fangbo is　　port (clk: in std_logic;　　din: in s

51、td_logic_vector(7 downto 0);　　dout:out std_logic_vector(7 downto 0));　　end fangbo;　　architecture behav of fangbo is　　signal da:std_logic

52、_vector(7 downto 0);　　signal db:std_logic;　　begin 　　db<=din(0);　　aa:process(db)　　beg

53、in　　if db'event and db='1' then　　if din>"01111111" then　　da<="00000000";　　else&

54、lt;/b>　　da<="11111111";　　end if;　　end if;　　end process;　　bb:p

55、rocess(clk)　　begin　　if clk'event and clk='1' then　　dout<=da;　　end if;</

56、b>　　end process;　　end behav;　　三角波：　　library ieee;　　use ieee.std_logic_1164.all;&l

57、t;p>　　use ieee.std_logic_unsigned.all;　　entity sanjiao is　　port (clk: in std_logic;　　din: in std_logic_vector(7 downto 0);　　dout:out

58、std_logic_vector(7 downto 0));　　end sanjiao;　　architecture behav of sanjiao is　　signal dc:std_logic_vector(7 downto 0);　　signal db:std_l

59、ogic;　　begin 　　db<=din(0);　　aa:process(db)　　variable da:std_logic_vector(7 downto 0);

60、;　　begin　　if db'event and db='1' then　　if din>"01111111" then　　if da="00000000" then 　　da:=

61、"00000100";　　end if;　　da:=da-4;　　else 　　if da<"11111100"

62、; then 　　da:=da+4;　　else 　　da:="11111000";　　end if;　　end

63、 if;　　end if;　　dc<=da;　　end process;　　bb:process(clk)

64、begin　　if clk'event and clk='1' then　　dout<=dc;　　end if;　　end process;<

65、;/p>　　end behav;　　鋸齒波　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_unsigned.all;<

66、;/p>　　entity juchi is　　port (clk: in std_logic;　　din: in std_logic_vector(7 downto 0);　　dout:out std_logic_vector(7 downto 0));<

67、p>　　end juchi;　　architecture behav of juchi is　　signal da:std_logic_vector(7 downto 0) :="00000000";　　signal db:std_logic;&

68、lt;b>　　begin 　　db<=din(0);　　process(db)　　begin　　if db'event and db='1' then&l

69、t;p>　　da<=da+2;　　end if;　　end process;　　process(clk)　　begin&l

70、t;p>　　if clk'event and clk='1' then　　dout<=da;　　end if;　　end process;　　end behav

71、;　　鍵盤(pán)掃描　　library ieee;　　use ieee.std_logic_1164.all;　　use ieee.std_logic_arith.all;　　use ieee.st

72、d_logic_unsigned.all;　　entity key is　　port(A,B,C,D:in std_logic;--鍵盤(pán)模塊的四個(gè)外接按鍵，編號(hào)依次是A、B、C、D　　clk_key:in std_logic;--時(shí)鐘信號(hào)，作為消抖計(jì)時(shí)　　key_valu

73、e:out std_logic_vector(1 downto 0);--輸出按鍵值　　out_clk:out std_logic:='0'--鍵值傳送脈沖信號(hào)，寬度為8個(gè)時(shí)鐘信號(hào)周期_| |____　　);　　end entity;&

74、lt;p>　　architecture art of key is　　signal key_value_1:std_logic_vector(1 downto 0);　　signal abcd:std_logic_vector(3 downto 0);　　begin&l

75、t;/p>　　abcd<=A&B&C&D;　　--------------------------------------------------------------------　　process(clk_key)　　variable counter:

76、 std_logic_vector(15 downto 0);　　variable state:integer range 4 downto 0;　　begin　　if rising_edge(clk_key)then　　case s

77、tate is　　when 0 => if (abcd(0)='0' or abcd(1)='0' or abcd(2)='0'or abcd(3)='0') then 　　state:=1;　　else

78、state:=0;　　end if;　　when 1 => if counter>="1111111111111110" then　　state:=2;　　coun

79、ter:="0000000000000000";　　else counter:=counter+1;　　state:=1;　　end if;　　when 2 => if

80、abcd(0)='0' or abcd(1)='0' or abcd(2)='0'or abcd(3)='0' then　　case abcd is　　when "0111"=>key_value_1<="00";state:=3;<

81、/p>　　when "1011"=>key_value_1<="01";state:=3;　　when "1101"=>key_value_1<="10";state:=3;　　when "1110"=&

82、gt;key_value_1<="11";state:=3;　　when others=>state:=0;　　end case;　　else state:=0;　　end if;&l

83、t;/b>　　when 3 => if (abcd(0)='0' or abcd(1)='0' or abcd(2)='0'or abcd(3)='0')then　　if counter>="0000000000000011"then ---------

84、--------------------------------　　counter:="0000000000000000";out_clk<='1';　　else counter:=counter+1;　　end if;</p&

85、gt;　　state:=3;　　else 　　state:=4;　　out_clk<='1';

86、　end if;　　when 4 => if counter>="0000000000000111" then　　state:=0;　　counter:="0000000000000000";out_cl

87、k<='0';　　else counter:=counter+1;　　state:=4;　　end if;　　end case;<

88、/p>　　end if;　　end process;　　--------------------------------------------------------------------------------　　process(key_va

89、lue_1)　　begin　　if clk_key'event and clk_key='0' then　　key_value<=key_value_1;　　end if;</b&

90、gt;　　end process;　　end art;　　數(shù)碼管顯示　　library ieee;　　use ieee.std_logic_1164.al

91、l;　　use ieee.std_logic_arith.all;　　use ieee.std_logic_unsigned.all;　　entity shuma is　　port(　　key

92、_clk :in std_logic;--由鍵盤(pán)模塊輸出的脈沖，用于數(shù)碼顯示模塊接受鍵值　　clk_shuma:in std_logic;　　key_in:in std_logic_vector(1 downto 0);　　duan:out std_logic_vector(7 downto 0);</p&

93、gt;　　wei:out std_logic_vector(3 downto 0);　　led_out1,led_out2:out std_logic_vector(3 downto 0):="1110";--LED顯示輸出，用于指示要調(diào)節(jié)的數(shù)碼管　　fhw_out:out std_logic_vector(27

94、 downto 0)　　);　　end shuma;　　architecture body_shuma of shuma is　　signal key_buff:std_logic_vector(1 downto 0);--輸入鍵值的

95、緩沖信號(hào)　　signal wei_buff:std_logic_vector(3 downto 0);--數(shù)碼管位選端的鎖存信號(hào)　　signal duan_buff:std_logic_vector(7 downto 0);　　----段的四個(gè)計(jì)數(shù)信號(hào),同時(shí)也是頻率的段碼值

96、;　　signal duan1:std_logic_vector(3 downto 0):="0001";　　signal duan2,duan3,duan4:std_logic_vector(3 downto 0):="0000";　　----[[[[[幅度的段碼十進(jìn)制值,幅度的初始化值是2200mv</p

97、>　　signal h_duan1,h_duan2:std_logic_vector(3 downto 0):="0010";　　signal h_duan3,h_duan4:std_logic_vector(3 downto 0):="0000";　　----段的四個(gè)顯示信號(hào)頻率計(jì)數(shù)初

98、值,按共陽(yáng)　　signal duan_1:std_logic_vector(7 downto 0):="00000110";--///'1'　　signal duan_2,duan_3,duan_4:std_logic_vector(7 downto 0):="00111111";--'0&

99、#39;　　----波形選擇信號(hào)　　signal select_1:std_logic_vector(1 downto 0):="10";　　----掃描時(shí)鐘信號(hào)　　signal scan_clk:std_logic_vector(1 downto 0

100、):="00";　　---------------------波形信號(hào)　　signal wave:std_logic_vector(3 downto 0):="1110";　　-----------------------------------------------&l

101、t;/p>　　signal flag:std_logic;　　begin　　--------------------------------------------------------------　　fhw_out<=duan1&

102、duan2&duan3&duan4&h_duan1&h_duan2&wave;　　--------------------------------------------------------------　　------------按鍵值接收進(jìn)程，通過(guò)接收脈沖，接收按鍵值----------

103、　　process(key_clk)　　begin　　if rising_edge(key_clk) then--用鍵值脈沖的上升沿來(lái)觸發(fā)鍵值的接收　　key_buff<=key_in;

104、end if;　　end process;　　-------------鍵值處理進(jìn)程---------　　process(key_buff)　　variable select_led1: std_logic_vector(3 downto 0):=&q

105、uot;1110";　　variable select_led2: std_logic_vector(3 downto 0):="1110";　　begin　　if key_clk'event and key_clk='0'

106、; then--用鍵值脈沖的下降沿來(lái)觸發(fā)　　if key_buff="01" then--波形選擇信號(hào)　　case select_led2 is　　when "0111"=>select_led2:="1110";<p

107、>　　when "1110"=>select_led2:="1101";　　when "1101"=>select_led2:="1011";　　when "1011"=>select_led2:="0111";

108、　　when others=>select_led2:="0111";　　end case;　　elsif key_buff="10" then----數(shù)碼管顯示進(jìn)程，用LED顯示，要調(diào)節(jié)的數(shù)碼管<p

109、>　　case select_led1 is　　when "0111"=>select_led1:="1110";　　when "1110"=>select_led1:="1101";　　when "110

110、1"=>select_led1:="1011";　　when "1011"=>select_led1:="0111";　　when others=>select_led1:="1110";

111、　　end case;　　elsif key_buff="11" then　　case select_led1 is　　when "1110"=>if flag='0'then　　if du

112、an1=9 then　　duan1<="0000";　　else　　duan1<=duan1+1;　　end if;

113、elsif flag='1'then　　if h_duan1=9 then　　h_duan1<="0000";　　else　　h_duan1<=h_duan1+1;

114、　　end if;　　end if;　　when "1101"=>if flag='0'then　　if duan2=9 then

115、　duan2<="0000";------------　　else　　duan2<=duan2+1;　　end if;　　elsif flag='1

116、9;then　　if h_duan2=9 then　　h_duan2<="0000";　　else　　h_duan2<=h_duan2+1;

117、　　end if;　　end if;　　when "1011"=>if flag='0'then　　if duan3=9 then　　duan3<="000

118、0";------------　　else　　duan3<=duan3+1;　　end if;　　elsif flag='1'then&l

119、t;p>　　h_duan3<="0000";　　end if;　　when "0111"=>if flag='0'then　　if duan4=9 then

120、duan4<="0000";　　else　　duan4<=duan4+1;　　end if;　　elsif flag='1'then</p&

121、gt;　　h_duan4<="0000";　　end if;　　when others=>select_led1:="1110";　　end case;</p

122、>　　elsif key_buff="00" then　　flag<=not flag;　　else 　　select_led1:="1110";　　selec

123、t_led2:="1110";　　end if;　　led_out2<=select_led2;--led_out2用于顯示波形　　led_out1<=select_led1;--led_out1用于顯示要調(diào)節(jié)的數(shù)碼管&

124、lt;p>　　wave<=select_led2;　　end if;　　end process;　　-----------------------------------------------　　------------

125、掃描間隔計(jì)數(shù)進(jìn)程------------------------------　　-----------------------------------------------　　process(clk_shuma,scan_clk)　　variable scan_counter:std_logic_vector(

126、17 downto 0):="000000000000000000";-----------改計(jì)數(shù)值-------------------------------------------　　begin　　if clk_shuma'event and clk_shuma='1'

127、; then　　scan_counter:=scan_counter+1;　　end if;　　scan_clk<=scan_counter(17 downto 16);-------------------------------------改計(jì)數(shù)值-</p&g

128、t;　　end process;　　------------段碼和位碼輸出進(jìn)程--------------　　process(scan_clk)　　begin　　case scan_clk is

129、;　　when "00" =>duan_buff<=duan_1;wei_buff<="0111";　　when "01" =>duan_buff<=duan_2;wei_buff<="1011";　　when &qu

130、ot;10" =>duan_buff<=duan_3;wei_buff<="1101";　　when "11" =>duan_buff<=duan_4;wei_buff<="1110";　　end case;&l

131、t;/p>　　end process;　　process(clk_shuma)　　begin　　if(clk_shuma'event and clk_shuma='1')then

132、duan<=duan_buff;wei<=wei_buff;　　end if;　　end process;　　------------------------------------------　　------------

133、數(shù)碼管計(jì)數(shù)值向顯示段碼轉(zhuǎn)換進(jìn)程　　--'0','1','2','3','4','5','6','7','8','9'　　--3fh,06h,5bh,4fh,66h,6dh,7dh,07h,7fh,

134、6fh　　------------------------------------------　　process(duan1)　　variable a:std_logic_vector(3 downto 0);　　begin</

135、p>　　if flag='0'then　　a:=duan1;　　elsif flag='1'then　　a:=h_duan1;　　end if;</b

136、>　　case a is　　when "0000"=>duan_1<="11000000";　　when "0001"=>duan_1<="11111001";<

137、;/p>　　when "0010"=>duan_1<="10100100";　　when "0011"=>duan_1<="10110000";　　when "0100"=>duan_1<=&

138、quot;10011001";　　when "0101"=>duan_1<="10010010";　　when "0110"=>duan_1<="10000010";　　when "0111

139、"=>duan_1<="11111000";　　when "1000"=>duan_1<="10000000";　　when "1001"=>duan_1<="10010000";<

140、;p>　　when others=>duan_1<="00000000";　　end case;　　end process;　　process(duan2)　　variable a:std_log

141、ic_vector(3 downto 0);　　begin　　if flag='0'then　　a:=duan2;　　elsif flag='1'then</

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