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1、覆旦大學(xué)碩士學(xué)位論文18V千兆以太網(wǎng)接收器模擬前端設(shè)計學(xué)校代碼:10246學(xué)號:032021093院系(所):信息科學(xué)LjI程學(xué)院專姓業(yè):微電子學(xué)與固體電子學(xué)名:易偉指導(dǎo)教師:李寧副教授完成日期:2006年5月1fi:ijAbstractAbstractInthispaperwefocusonthedesignofthe18VsupplyanalogreceiverusedinthegigabitEthernetsystemThelay
2、outofthefnalcircuit,theverificationandsometestaregiveninthelastpartofthepaperFirstweintroducethebasicknowledgeofthe1000Base—tThen,basedonthecriterionofthe1000Base—T,wemodelthetwistedpai5ADCandtheequalizersimulatethewhole
3、systemSOthatwedecidetheguidelineoftheeachpartoftheanalogreceivenWethenpresentthedesignofthewholecircuitwhichmainlyincludesthreeparts一theechocancellerthebaselinewandercancellerthevariablegainamplifierTheckcuitmainlyrealiz
4、esthefunctionsofthecancelingoftheecho,thecancelingofthebaselinewandertheautocontrollingofthegainThelayoutofthecircuitandtheverificationsuchassimulationandtestaregiveninthepaperAccordingtotheverificationofthecircuit,theci
5、rcuitCanrealizethefunctionsneededwellAtlast,wediscussthewholeworkofthepaper,andgivesomeadvisesforthefutureWOrkThecircuitisimplementedbytheSMICstandard1P6MCMOStechnologyThewholeareais320um880umandthepowerdissipationiSabou
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