10比特50兆采樣頻率Pipeline結(jié)構(gòu)模數(shù)轉(zhuǎn)換器的設(shè)計.pdf_第1頁
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文檔簡介

1、隨著技術(shù)的高速發(fā)展,集成電路的功能也變得越來越強(qiáng),能夠在同一塊硅片上同時實現(xiàn)模擬電路和數(shù)字電路的片上系統(tǒng)成為集成電路的發(fā)展方向。設(shè)計出與數(shù)字工藝兼容并且達(dá)到性能要求的模數(shù)轉(zhuǎn)換接口電路(ADC)成為片上系統(tǒng)設(shè)計中的重點。
　　 本文對現(xiàn)今的各種高速、高分辨率的ADC結(jié)構(gòu)進(jìn)行了分析比較,最終確定使用流水線(Pipeline)模數(shù)轉(zhuǎn)換器結(jié)構(gòu)。采用每級1.5位,一共9級流水結(jié)構(gòu)。電路的設(shè)計有如下特點:高增益、高帶寬的運(yùn)算放大器與改進(jìn)的柵

2、壓自舉(bootstrap)采樣開關(guān)的結(jié)合大大提高了采樣保持電路的精度和線性度；電流型帶隙基準(zhǔn)電路采用一種全新的設(shè)計方法提高了基準(zhǔn)電路設(shè)計的準(zhǔn)確性；基準(zhǔn)電路和相應(yīng)的電壓緩沖器電路組合為片內(nèi)基準(zhǔn)電路為整個ADC芯片提供電壓基準(zhǔn)；優(yōu)化的偏置電路提高了運(yùn)放整體的一致性和穩(wěn)定性；雙相非交疊時鐘產(chǎn)生電路提高了時鐘周期的利用率；使用動態(tài)比較器電路來提高速度和降低功耗,該動態(tài)比較器直流功耗為0。
　　 該模數(shù)轉(zhuǎn)換器電路基于1.8伏單電源供電的

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