2023年全國碩士研究生考試考研英語一試題真題(含答案詳解+作文范文)_第1頁
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文檔簡介

1、隨著近些年通信行業(yè)的高速發(fā)展,通信領(lǐng)域的范圍正在不斷的擴(kuò)展。無線傳感網(wǎng)(Wireless Sensor Network,WSN)正是其中典型的一例。無線傳感網(wǎng)是一種應(yīng)用于短距離范圍內(nèi),低傳輸數(shù)據(jù)速率下的各種電子設(shè)備之間的無線通信網(wǎng)絡(luò),并以其低功耗、低成本、分布式和自組織的特點(diǎn)使得其不僅在工業(yè)、農(nóng)業(yè)、軍事、環(huán)境、醫(yī)療等傳統(tǒng)領(lǐng)域有著巨大的運(yùn)用價(jià)值,而且在未來可以應(yīng)用到人類日常生活和社會(huì)生產(chǎn)活動(dòng)的許多領(lǐng)域中,具有很大的研究價(jià)值。
  本

2、文6位DAC的設(shè)計(jì)基于TSMC0.18μm CMOS工藝,采用目前應(yīng)用廣泛的電流舵結(jié)構(gòu),DAC的輸出端搭配負(fù)載電阻來提供電壓輸出。在詳細(xì)地介紹DAC相關(guān)技術(shù)指標(biāo)以及一些常見DAC基本結(jié)構(gòu)的基礎(chǔ)上,進(jìn)行了電流舵型DAC的靜態(tài)和動(dòng)態(tài)誤差分析。為了對DAC進(jìn)行優(yōu)化設(shè)計(jì),著重分析了電流源匹配誤差和有限輸出阻抗對DAC性能的影響。本文給出了電流舵型DAC的電路設(shè)計(jì)、前仿真、版圖設(shè)計(jì)和后仿真,并進(jìn)行了流片和芯片測試。芯片面積約為750μm×500μ

3、m。芯片測試結(jié)果表明:在1.8V芯片工作電壓下,DAC的微分非線性(DNL)約為0.12LSB,積分非線性(INL)約為0.14LSB。當(dāng)時(shí)鐘頻率是16MHz,且DAC的輸入信號頻率分別為92kHz和400.6kHz時(shí),DAC的無雜散動(dòng)態(tài)范圍(SFDR)分別為38.86dB和35.47dB,電路的功耗分別為1.55mW和1.83mW。后仿真結(jié)果顯示DAC的有效位達(dá)到了5.97位。
  本論文設(shè)計(jì)的6位DAC經(jīng)過進(jìn)一步的優(yōu)化,可應(yīng)用

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