基于FPGA的LDPC碼編譯碼算法的設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁(yè)
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1、LDPC碼是一類性能優(yōu)異的線性分組碼,當(dāng)碼長(zhǎng)足夠長(zhǎng)時(shí),性能比Turbo碼更優(yōu)越。相對(duì)于非結(jié)構(gòu)化的隨機(jī)LDPC碼,準(zhǔn)循環(huán)LDPC碼因?yàn)闃?gòu)造更加靈活、硬件可實(shí)現(xiàn)性強(qiáng)、可進(jìn)行并行度設(shè)計(jì)及模塊復(fù)用,成為當(dāng)前的一個(gè)研究熱點(diǎn)。
   本文在LDPC碼理論基礎(chǔ)上,介紹了一種PS構(gòu)造方法,該方法通過隨機(jī)搜索構(gòu)造滿足一定條件的轉(zhuǎn)移矩陣,再根據(jù)一定的原則得到對(duì)應(yīng)的校驗(yàn)矩陣。針對(duì)PS構(gòu)造下得到的(6075,5402)QC-LDPC碼,基于MATLAB

2、仿真軟件,對(duì)不同參數(shù)下的糾錯(cuò)性能進(jìn)行了仿真驗(yàn)證。通過對(duì)相同碼長(zhǎng)下PS構(gòu)造與隨機(jī)構(gòu)造得到的LDPC碼進(jìn)行性能對(duì)比,驗(yàn)證了該構(gòu)造法的可行性。
   針對(duì)(6075,5402)QC-LDPC碼,文中設(shè)計(jì)了其編譯碼算法的FPGA實(shí)現(xiàn)方案,并在QuartusⅡ仿真平臺(tái)上,利用VHDL硬件語(yǔ)言完成編程仿真。編碼部分,根據(jù)生成矩陣的循環(huán)特性,采用反饋移位寄存器進(jìn)行設(shè)計(jì),大大降低了實(shí)現(xiàn)復(fù)雜度。譯碼部分,采用部分并行結(jié)構(gòu),對(duì)最小和譯碼算法,分模塊

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