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文檔簡介
1、本文進行AAC和MP3解碼中部分運算模塊的設計。首先介紹了本文要進行硬件設計的運算模塊的原理和解碼流程。其次從硬件設計的角度對AAC中PNS運算模塊和MP3中立體聲處理的算法進行優(yōu)化，利用專用的數(shù)據(jù)處理模塊建立PNS等運算模塊的硬件仿真模型。然后將設計的模塊集成到AAC和MP3解碼器中，并綜合到FPGA開發(fā)板上，PNS消耗191個邏輯單元，立體聲處理消耗510個邏輯單元，IMDCT消耗594個邏輯單元。利用FPGA驗證平臺對MP3和AA
2、C解碼器進行充分的驗證，并進行0.18umCMOS工藝流片。最后對芯片進行測試，AAC中PNS、SBR和PS效果明顯，MP3音質(zhì)良好。解碼采樣率48kHz，比特率96kbps的AAC測試矢量功耗為11mW，解碼采樣率48kHz，比特率128kbps的MP3測試矢量功耗為9.5mW。
本文在運算模塊設計之外，還分別進行了基于Linux和Android的DAB應用開發(fā)。設計基于Linux的DAB接收終端底層驅(qū)動程序，使終端的A
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