Turbo碼及RS-Turbo級(jí)聯(lián)碼的FPGA實(shí)現(xiàn).pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、自1993年Turbo碼提出以來,Turbo碼以其接近Shannon限的性能激起了編碼界研究Turbo碼的熱情。如今,盡管前人已經(jīng)在編碼參數(shù)設(shè)計(jì)、算法改進(jìn)、性能仿真和實(shí)現(xiàn)等方面做了大量的工作,但Turbo碼仍是當(dāng)前信道編碼領(lǐng)域研究的熱點(diǎn)之一。
　　本文以FPGA硬件實(shí)現(xiàn)Turbo編譯碼器為主要目標(biāo)。在實(shí)現(xiàn)Turbo編譯碼器的基礎(chǔ)上,用FPGA設(shè)計(jì)并實(shí)現(xiàn)了RS-Turbo級(jí)聯(lián)碼。
　　本文實(shí)現(xiàn)的Turbo譯碼器,采用時(shí)分復(fù)用的

2、思想,即用一塊SISO模塊完成Turbo譯碼器的迭代運(yùn)算;用兩塊ROM存儲(chǔ)器和一塊RAM存儲(chǔ)器完成外信息的存儲(chǔ)、交織和解交織的功能。在計(jì)算前向度量和后向度量的過程中,本文借用DSP中指令流水線的思想,分別設(shè)計(jì)了前向度量和后向度量的計(jì)算模塊。
　　針對(duì)傳統(tǒng)Turbo譯碼器的設(shè)計(jì),本文提出一種改進(jìn)的實(shí)現(xiàn)方案,該方案可減少一個(gè)幀長(zhǎng)時(shí)鐘周期的譯碼延時(shí)和節(jié)省一個(gè)解交織模塊的硬件資源。
　　本文利用RS譯碼器的檢錯(cuò)結(jié)果,反饋控制RS-T

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